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参数资料
| 型号： | EPM7032BLC44-3 |
| 厂商： | Altera |
| 文件页数： | 4/66页 |
| 文件大小： | 0K |
| 描述： | IC MAX 7000 CPLD 32 44-PLCC |
| 标准包装： | 130 |
| 系列： | MAX® 7000B |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 3.5ns |
| 电压电源 - 内部： | 2.375 V ~ 2.625 V |
| 逻辑元件/逻辑块数目： | 2 |
| 宏单元数： | 32 |
| 门数： | 600 |
| 输入/输出数： | 36 |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-LCC（J 形引线） |
| 供应商设备封装： | 44-PLCC（16.58x16.58） |
| 包装： | 管件 |
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Altera Corporation
MAX 7000B Programmable Logic Device Data Sheet
Figure 5. MAX 7000B PIA Routing
While the routing delays of channel-based routing schemes in masked or
field-programmable gate arrays (FPGAs) are cumulative, variable, and
path-dependent, the MAX 7000B PIA has a predictable delay. The PIA
makes a design’s timing performance easy to predict.
I/O Control Blocks
The I/O control block allows each I/O pin to be individually configured
for input, output, or bidirectional operation. All I/O pins have a tri-state
buffer that is individually controlled by one of the global output enable
control block for MAX 7000B devices. The I/O control block has
six or ten global output enable signals that are driven by the true or
complement of two output enable signals, a subset of the I/O pins, or a
subset of the I/O macrocells.
To LAB
PIA Signals
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| EPM7032BLC44-5 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BLC44-7 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Altera Corporation 功能描述: |
| EPM7032BTC44-3 | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-3N | 制造商:Altera Corporation 功能描述:IC MAX |
| EPM7032BTC44-5 | 制造商:Altera Corporation 功能描述:CPLD MAX 7000B Family 600 Gates 32 Macro Cells 212.8MHz CMOS Technology 2.5V 44-Pin TQFP |
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