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参数资料
| 型号： | EPM7062B |
| 厂商： | Altera Corporation |
| 英文描述： | Programmable Logic Device Family(MAX7000B可编程逻辑系列器件) |
| 中文描述： | 可编程逻辑器件系列（MAX7000B可编程逻辑系列器件） |
| 文件页数： | 18/125页 |
| 文件大小： | 1053K |
| 代理商： | EPM7062B |
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18
Altera Corporation
MAX 7000B Programmable Logic Device Family Data Sheet
Preliminary Information
Figure 8
shows the timing information for the JTAG signals.
Figure 8. MAX 7000B JTAG Waveforms
Table 7
shows the JTAG timing parameters and values for MAX 7000B
devices.
Table 7. JTAG Timing Parameters & Values for MAX 7000B Devices
Note (1)
Symbol
Parameter
Min
Max
Unit
t
JCP
t
JCH
t
JCL
t
JPSU
t
JPH
t
JPCO
t
JPZX
t
JPXZ
t
JSSU
t
JSH
t
JSCO
t
JSZX
t
JSXZ
TCK
clock period
100
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
TCK
clock high time
50
TCK
clock low time
50
JTAG port setup time
20
JTAG port hold time
45
JTAG port clock to output
25
JTAG port high impedance to valid output
25
JTAG port valid output to high impedance
25
Capture register setup time
20
Capture register hold time
45
Update register clock to output
25
Update register high impedance to valid output
25
Update register valid output to high impedance
25
TDO
TCK
t
JPZX
t
JPCO
t
JPH
t
JPXZ
t
JCP
t
JPSU
t
JCL
t
JCH
TDI
TMS
Signal
to Be
Captured
Signal
to Be
Driven
t
JSZX
t
JSSU
t
JSH
t
JSCO
t
JSXZ
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PDF描述 |
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