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参数资料
| 型号： | EPM7064AETI44-7N |
| 厂商： | Altera |
| 文件页数： | 5/64页 |
| 文件大小： | 0K |
| 描述： | IC MAX 7000 CPLD 64 44-TQFP |
| 产品变化通告： | Bond Wire Change 4/Sept/2008 |
| 标准包装： | 480 |
| 系列： | MAX® 7000A |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 7.5ns |
| 电压电源 - 内部： | 3 V ~ 3.6 V |
| 逻辑元件/逻辑块数目： | 4 |
| 宏单元数： | 64 |
| 门数： | 1250 |
| 输入/输出数： | 36 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 44-TQFP |
| 供应商设备封装： | 44-TQFP（10x10） |
| 包装： | 托盘 |
| 产品目录页面： | 604 (CN2011-ZH PDF) |
| 其它名称： | 544-2011 EPM7064AETI44-7N-ND |
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Altera Corporation
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MAX 7000A Programmable Logic Device Data Sheet
Figure 5. MAX 7000A PIA Routing
While the routing delays of channel-based routing schemes in masked or
FPGAs are cumulative, variable, and path-dependent, the MAX 7000A
PIA has a predictable delay. The PIA makes a design’s timing
performance easy to predict.
I/O Control Blocks
The I/O control block allows each I/O pin to be individually configured
for input, output, or bidirectional operation. All I/O pins have a tri-state
buffer that is individually controlled by one of the global output enable
control block for MAX 7000A devices. The I/O control block has 6 or
10 global output enable signals that are driven by the true or complement
of two output enable signals, a subset of the I/O pins, or a subset of the
I/O macrocells.
To LAB
PIA Signals
相关PDF资料 |
PDF描述 |
|---|---|
| VI-21B-CY-F3 | CONVERTER MOD DC/DC 95V 50W |
| 4-640861-5 | 15P MTA156 EDGE CONN ASSY LF |
| GBC17DRES-S13 | CONN EDGECARD 34POS .100 EXTEND |
| EPM7064STI44-7 | IC MAX 7000 CPLD 64 44-TQFP |
| LTC4224IDDB-1#TRPBF | IC CNTRLR HOT SWAP DUAL 10-DFN |
相关代理商/技术参数 |
参数描述 |
|---|---|
| EPM7064B | 制造商:ALTERA 制造商全称:Altera Corporation 功能描述:Programmable Logic Device |
| EPM7064BBC169-3 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
| EPM7064BBC169-5 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
| EPM7064BBC169-7 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
| EPM7064BBC49-3 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:ASIC |
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