参数资料
型号: EVAL-AD7641CBZ
厂商: Analog Devices Inc
文件页数: 25/28页
文件大小: 0K
描述: BOARD EVALUATION FOR AD7641
产品培训模块: ADC Applications
ADC Architectures
ADC DC/AC Performance
标准包装: 1
系列: PulSAR®
ADC 的数量: 1
位数: 18
采样率(每秒): 2M
数据接口: 串行
输入范围: ±2.5 V
在以下条件下的电源(标准): 2MSPS 带内部基准时为 75mW
工作温度: -40°C ~ 85°C
已用 IC / 零件: AD7641
已供物品:
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AD7641BCPZ-ND - IC ADC 18BIT 2MSPS SAR 48-LFCSP
AD7641
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Table 4. Serial Clock Timings in Master Read After Convert Mode
DIVSCLK[1]
0
1
DIVSCLK[0]
Symbol
0
1
0
1
Unit
SYNC to SCLK First Edge Delay Minimum
t18
0.5
3
ns
Internal SCLK Period Minimum
t19
8
16
32
64
ns
Internal SCLK Period Maximum
t19
14
26
52
103
ns
Internal SCLK High Minimum
t20
2
6
15
31
ns
Internal SCLK Low Minimum
t21
3
7
16
32
ns
SDOUT Valid Setup Time Minimum
t22
1
5
ns
SDOUT Valid Hold Time Minimum
t23
0
0.5
10
28
ns
SCLK Last Edge to SYNC Delay Minimum
t24
0
0.5
9
26
ns
BUSY High Width Maximum
t24
0.630
0.870
1.350
2.28
μs
04
76
1-
00
2
NOTE
IN SERIAL INTERFACE MODES, THE SYNC, SCLK, AND
SDOUT TIMING ARE DEFINED WITH A MAXIMUM LOAD
CL OF 10pF; OTHERWISE, THE LOAD IS 60pF MAXIMUM.
500AIOL
500AIOH
1.4V
TO OUTPUT
PIN
CL
50pF
Figure 2. Load Circuit for Digital Interface Timing,
SDOUT, SYNC, and SCLK Outputs, CL = 10 pF
0.8V
2V
0.8V
2V
tDELAY
0
476
1-
00
3
Figure 3. Voltage Reference Levels for Timing
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