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参数资料
| 型号： | HD6477034X20V |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, OTPROM, 20 MHz, RISC MICROCONTROLLER, PQFP120 |
| 封装： | 14 X 14 MM, 0.40 MM PITCH, PLASTIC, TQFP-120 |
| 文件页数： | 101/186页 |
| 文件大小： | 6667K |
| 代理商： | HD6477034X20V |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页当前第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页
Rev. 7.00 Jan 31, 2006 page xxi of xxvi
13.4 SCI Interrupt Sources and the DMAC .............................................................................. 407
13.5 Usage Notes ...................................................................................................................... 407
Section 14 A/D Converter................................................................................................. 411
14.1 Overview........................................................................................................................... 411
14.1.1 Features................................................................................................................ 411
14.1.2 Block Diagram ..................................................................................................... 412
14.1.3 Configuration of Input Pins.................................................................................. 413
14.1.4 Configuration of A/D Registers ........................................................................... 414
14.2 Register Descriptions ........................................................................................................ 414
14.2.1 A/D Data Registers A–D (ADDRA–ADDRD).................................................... 414
14.2.2 A/D Control/Status Register (ADCSR)................................................................ 415
14.2.3 A/D Control Register (ADCR)............................................................................. 417
14.3 CPU Interface.................................................................................................................... 418
14.4 Operation........................................................................................................................... 420
14.4.1 Single Mode (SCAN = 0)..................................................................................... 420
14.4.2 Scan Mode (SCAN = 1) ....................................................................................... 422
14.4.3 Input Sampling Time and A/D Conversion Time ................................................ 424
14.4.4 A/D Conversion Start by External Trigger Input ................................................. 425
14.5 Interrupts and DMA Transfer Requests ............................................................................ 425
14.6 Definitions of A/D Conversion Accuracy ......................................................................... 426
14.7 A/D Converter Usage Notes.............................................................................................. 427
14.7.1 Setting Analog Input Voltage............................................................................... 427
14.7.2 Handling of Analog Input Pins ............................................................................ 427
14.7.3 Switchover between Analog Input and General Port Functions........................... 428
Section 15 Pin Function Controller (PFC) ................................................................... 429
15.1 Overview........................................................................................................................... 429
15.2 Register Configuration ...................................................................................................... 431
15.3 Register Descriptions ........................................................................................................ 431
15.3.1 Port A I/O Register (PAIOR)............................................................................... 431
15.3.2 Port A Control Registers (PACR1 and PACR2) .................................................. 432
15.3.3 Port B I/O Register (PBIOR) ............................................................................... 437
15.3.4 Port B Control Registers (PBCR1 and PBCR2)................................................... 438
15.3.5 Column Address Strobe Pin Control Register (CASCR) ..................................... 444
Section 16 I/O Ports (I/O) ................................................................................................. 447
16.1 Overview........................................................................................................................... 447
16.2 Port A................................................................................................................................ 447
16.2.1 Register Configuration......................................................................................... 447
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