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参数资料
| 型号： | HD6477034X20V |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, OTPROM, 20 MHz, RISC MICROCONTROLLER, PQFP120 |
| 封装： | 14 X 14 MM, 0.40 MM PITCH, PLASTIC, TQFP-120 |
| 文件页数： | 63/186页 |
| 文件大小： | 6667K |
| 代理商： | HD6477034X20V |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页当前第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页第183页第184页第185页第186页
Section 8 Bus State Controller (BSC)
Rev. 7.00 Jan 31, 2006 page 129 of 658
REJ09B0272-0700
As table 8.7 shows, specific spaces such as DRAM space and address/data multiplexed I/O space
are allocated to the 8 areas. Each of the spaces is equipped with the necessary interfaces. The
control signals needed by DRAM and peripheral chips will be output by the chip to devices
connected to an area allocated to the appropriate type of space.
8.3.2
Bus Width
The primary bus width selection for this chip is made by switching between 8 bits and 16 bits
using the A27 bit. When A27 is 0, the bus width is 8 bits and data is input/output through the
AD7–AD0 pins; when A27 is 1, the size is 16 bits and data is input/output through the AD15–
AD0 pins for word accesses. For byte access, the upper byte is input/output through AD15–AD8
and the lower byte through AD7–AD0. When the bus width is 8 bits or byte access is being
performed with a 16-bit bus width, the status of the eight AD pins that are not inputting/outputting
data is as shown in appendix B, Pin States.
Bus widths are also determined by conditions other than the A27 bit for specific areas:
Area 0 is an 8-bit external memory space when the MD2–MD0 pins are 000, a 16-bit external
memory space when these bits are 001, and a 32-bit on-chip ROM space when they are 010
(the on-chip ROM is available only in the SH7034).
Area 5 is an 8-bit on-chip supporting module space when the A27 bit and A8 bit are both 0 and
a 16-bit on-chip supporting module space when the A27 bit is 0 and the A8 bit is 1. When the
A27 bit is 1, it is a 16-bit external memory space.
Area 6 has an 8-bit bus width when the A27 bit and A14 bit are both 0 and a 16-bit bus width
when the A27 bit is 0 and the A14 bit is 1. When the A27 bit is 1, it is a 16-bit space.
Area 7 is a 32-bit on-chip RAM space when the A27 bit is 1 and an 8-bit external memory
space when the A27 bit is 0.
Word (16-bit) data accessed from 8-bit bus areas and longword (32-bit) data accessed from 16-bit
bus areas require two consecutive accesses. Longword (32-bit) data accessed from 8-bit bus areas
requires four consecutive accesses.
8.3.3
Chip Select Signals (
CS0
CS0–CS7
CS7
CS7)
When the A26–A24 bits of the address are decoded, they become chip select signals (
CS0–CS7)
for areas 0–7. When an area is accessed, the corresponding chip select pin is driven low. Table 8.8
shows the relationship between the A26–A24 bits and the chip select signals.
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