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参数资料
| 型号： | HW-SPAR3ADDR2-DK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 129/140页 |
| 文件大小： | 0K |
| 描述： | KIT DEV SPARTAN 3A DDR2 SDRAM |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 12/Jan/2009 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 主要目的： | 存储器，DDR2 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | XC3S700A |
| 主要属性： | DDR2 接口 |
| 次要属性： | 图形用户界面 |
| 已供物品： | 板，线缆，CD，电源 |
| 其它名称： | 122-1575 |
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R
Six-Pin Accessory Headers
Six-Pin Accessory Headers
The six-pin accessory headers provide easy I/O interface expansion using the various
Digilent Peripheral Modules.
J18 Header
The J18 header, shown in Figure 15-8 , is located in the bottom right corner of the board,
along the right edge, adjacent to the BTN_EAST push button. It uses a female six-pin 90°
socket. Four FPGA pins connect to the J18 header, J18_IO<4:1>. The board supplies 3.3V to
the accessory board mounted in the J18 socket on the bottom pin.
FPGA
(AA21)
(AB21)
(AA19)
(AB19)
J18
J18_IO1
J18_IO2
J18_IO3
J18_IO4
GND
3.3V
UG334_c15_08_052407
Figure 15-8:
FPGA Connections to the J18 Accessory Header
J19 Header
The J19 header, shown in Figure 15-9 , is left unpopulated on the board. Four FPGA pins
connect to the J19 header, J19_IO<4:1>. The board supplies 3.3V to the accessory board
mounted in the J19 socket on the bottom pin.
FPGA
(Y18)
(W18)
(V17)
J19_IO1
J19_IO2
J19_IO3
J19
(W17) J19_IO4
GND
3.3V
These pins connect to unpopulated mounting holes.
UG334_c15_09_052407
Figure 15-9:
FPGA Connections to the J19 Accessory Header
Spartan-3A/3AN FPGA Starter Kit Board User Guide www.xilinx.com
UG334 (v1.1) June 19, 2008
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PDF描述 |
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参数描述 |
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