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参数资料
| 型号： | HW-SPAR3ADDR2-DK-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 85/140页 |
| 文件大小： | 0K |
| 描述： | KIT DEV SPARTAN 3A DDR2 SDRAM |
| 产品变化通告： | Adapter Replacement 23/May/2008 Development Systems Discontinuation 12/Jan/2009 |
| 标准包装： | 1 |
| 系列： | Spartan®-3A |
| 主要目的： | 存储器，DDR2 |
| 嵌入式： | 是，FPGA / CPLD |
| 已用 IC / 零件： | XC3S700A |
| 主要属性： | DDR2 接口 |
| 次要属性： | 图形用户界面 |
| 已供物品： | 板，线缆，CD，电源 |
| 其它名称： | 122-1575 |
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R
Table 11-1:
FPGA-to-Flash Connections (Continued)
Flash Connections
NOR Flash
FPGA Pin
Category
Signal Name
NF_D15
(NF_A0)
NF_D14
NF_D13
NF_D12
NF_D11
NF_D10
NF_D9
NF_D8
NF_D7
NF_D6
NF_D5
NF_D4
NF_D3
NF_D2
NF_D1
NF_D0
(SPI_MISO)
Number
T17
R21
T22
U22
U21
V22
W22
T20
Y9
AB9
Y11
AB11
U13
AA17
Y17
AB20
Function
Upper 8 bits of a 16-bit halfword when Flash is
configured for x16 data (NF_BYTE=High). The
Flash does not have a dedicated D15 pin.
Instead, this function is shared with the least-
significant address pin. On the Flash memory
component, this pin is named D15/A-1, which
connects to the FPGA’s A0 address pin. After
configuration, if the FPGA application asserts
NF_BYTE-High, use NF_A0 to carry the D15
signal. Connect the other higher-order data
lines to FPGA user I/Os.
Upper 7 bits of a data byte or lower 8 bits of a
16-bit halfword. Connects to FPGA pins D[7:1]
to support the BPI configuration.
Bit 0 of a data byte and a 16-bit halfword.
Connects to FPGA pin D0/DIN to support the
BPI configuration. Shared with other SPI
peripherals and Platform Flash PROM.
Spartan-3A/3AN FPGA Starter Kit Board User Guide www.xilinx.com
UG334 (v1.1) June 19, 2008
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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