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参数资料
| 型号： | HW-V5-ML501-UNI-G |
| 厂商： | Xilinx Inc |
| 文件页数： | 29/42页 |
| 文件大小： | 0K |
| 描述： | EVALUATION PLATFORM VIRTEX-5 |
| 产品变化通告： | Adapter Replacement 23/May/2008 |
| 设计资源： | ML501 Ref Design User Guide ML501 Schematics |
| 标准包装： | 1 |
| 系列： | Virtex®-5 LX |
| 类型： | FPGA |
| 适用于相关产品： | XC5VLX50FFG676 |
| 所含物品： | ML501 平台、DVI 适配器和 CompactFlash 卡 |
| 相关产品： | XC5VLX50T-3FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-3FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-3FF1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FFG1136I-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FFG1136C-ND - IC FPGA VIRTEX-5 50K 1136FBGA XC5VLX50T-2FF665I-ND - IC FPGA VIRTEX-5 50K 665FCBGA XC5VLX50T-2FF665C-ND - IC FPGA VIRTEX-5 50K 665FCBGA 更多... |
| 其它名称： | 122-1508 |
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Table 1-13:
R
Detailed Description
settings (See Table 1-13 ). These settings can be overwritten via software. Jumper J40 selects
whether the PHY defaults to RGMII mode (pin 2-3) or GMII mode (pin 1-2).
Board Connections for PHY Configuration Pins
Config Pin
CONFIG0
CONFIG1
CONFIG2
CONFIG3
CONFIG4
CONFIG5
CONFIG6
Connection on
Board
V CC 2.5V
Ground
V CC 2.5V
V CC 2.5V
V CC 2.5V or
LED_DUPLEX
(Set by J40)
V CC 2.5V
LED_RX
Bit[2]
Definition and Value
PHYADR[2] = 1
ENA_PAUSE = 0
ANEG[3] = 1
ANEG[0] = 1
HWCFG_MODE[2] = 0 or 1
(Set by J40)
DIS_FC = 1
SEL_BDT = 0
Bit[1]
Definition and Value
PHYADR[1] = 1
PHYADR[4] = 0
ANEG[2] = 1
ENA_XC = 1
HWCFG_MODE[1] = 1
DIS_SLEEP = 1
INT_POL = 1
Bit[0]
Definition and Value
PHYADR[0] = 1
PHYADR[3] = 0
ANEG[1] = 1
DIS_125 = 1
HWCFG_MODE[0] = 1
HWCFG_MODE[3] = 1
75/50 Ω = 0
22. USB Controller with Host and Peripheral Ports
A Cypress CY7C67300 embedded USB host controller provides USB connectivity for the
board. The USB controller supports host and peripheral modes of operation. The USB
controller has two serial interface engines (SIE) that can be used independently. SIE1 is
connected to the USB Host connector (P19). SIE2 is connected only to the USB Peripheral
connector (P17).
The USB controller has an internal microprocessor to assist in processing USB commands.
The firmware for this processor can be stored in its own dedicated IIC EEPROM (U28) or
can be downloaded from a host computer via a peripheral connector. The USB controller's
serial port is connected to J30 through an RS-232 transceiver to assist with debug. Jumper
J50 can be installed to prevent the USB controller from executing firmware stored in the IIC
EEPROM.
ML501 Evaluation Platform
UG226 (v1.4) August 24, 2009
29
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