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参数资料
| 型号： | IA82527-PTQ44A-R |
| 厂商： | Innovasic Semiconductor |
| 英文描述： | Serial Communications Controller CAN Protocol |
| 中文描述： | 串行通信控制器的CAN协议 |
| 文件页数： | 32/45页 |
| 文件大小： | 1760K |
| 代理商： | IA82527-PTQ44A-R |
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IA82527
CAN Serial Communications Controller
As of Production Ver. 00
PRELIMINARY
Table 9. Mode 2 General Bus Timing
04 May 2007
Copyright
2007
EN21070504-00
www.Innovasic.com
Customer Support:
Page 32 of 45
1-888-824-4184
Symbol
Parameter
Minimum
Maximum
1/t
XTAL
1/t
SCLK
1/t
MCLK
t
AVSL
t
SLAX
t
ELDZ
Oscillator Frequency
System Clock Frequency
Memory Clock Frequency
Address Valid to
as
Low
Address Hold after
as
Low
Data Float after
e
Low
e
High to Data Valid for Registers 02H,
04H, 05H
e
High to Data Valid (all Registers except
for 02H, 04H, 05H) for Read Cycle without a
Previous Write
e
High to Data Valid (all Registers except
for 02H, 04H, 05H) for Read Cycle with a
Previous Write
Data Setup to
e
Low
Input Data Hold after
e
Low
e
Low to Output Data Valid on Port 1/2
e
High Time
as
High Time
Setup Time of
r-w_n
to
e
High
as
Low to
e
High
cs_n
Low to
as
Low
e
Low to
cs_n
High
clkout
Period
(CD
V
is the value loaded in the CLKOUT
Register representing the
clkout
divisor.)
clkout
High Period
(CD
V
is the value loaded in the CLKOUT
Register representing the
clkout
divisor.)
8 MHz
4 MHz
2 MHz
7.5 ns
10 ns
0 ns
16 MHz
10 MHz
8 MHz
45 ns
0 ns
45 ns
—
1.5 t
mclk
+ 100 ns
t
EHDV
—
3.5 t
mclk
+ 100 ns
t
QVEL
t
ELQX
t
ELDV
t
EHEL
t
SHSL
t
RSEH
t
SLEH
t
CLSL
t
ELCH
30 ns
20 ns
t
mclk
45 ns
30 ns
30 ns
20 ns
20 ns
0 ns
—
—
2 t
mclk
+ 500 ns
—
—
—
—
—
t
COPD
(CD
V
+ 1)
t
osc
t
CHCL
(CD
V
+ 1)
t
osc
– 10
(CD
V
+ 1)
t
osc
– 15
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