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参数资料
| 型号： | IA88C00-PDW48I |
| 厂商： | Innovasic Semiconductor |
| 英文描述： | Microcontroller |
| 中文描述： | 微控制器 |
| 文件页数： | 44/80页 |
| 文件大小： | 707K |
| 代理商： | IA88C00-PDW48I |
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IA88C00
Microcontroller
Data Sheet
As of Production Version -01
Copyright
2005 ENG 21 0 050519-00 www.Innovasic
Innovasic.com
Innovasic Semiconductor
Page 44 of 80 1.888.824.4184
Figure 47. External Memory Timing Register, R254 Bank 0
Bit
7
D7
1
R/W
6
D6
0
R/W
5
D5
0
R/W
4
D4
0
R/W
3
D3
0
R/W
2
D2
0
R/W
1
D1
1
R/W
0
D0
1
R/W
Initial Value
Read/Write
This register controls all the extended bus timing features.
D0 - DMA Select
- If 0, DMA uses register file space. If 1, it uses Data Memory.
D1 - Stack Select
- If 0, stack is located in register file space. If 1, it is located in Data Memory.
Figure 48. Interrupt Priority Register (IPR), R255 Bank 0
Bit
7
D7
X
R/W
6
D6
X
R/W
5
D5
X
R/W
4
D4
X
R/W
3
D3
X
R/W
2
D2
X
R/W
1
D1
X
R/W
0
D0
X
R/W
Initial Value
Read/Write
The Interrupt Priority register defines the priority order of the interrupt levels. Interrupts should be
globally disabled before writing to this register.
D0
- Group A - 0=IRQ0 > IRQ1; 1=IRQ1 > IRQ0.
D2
- Group B - 0=IRQ2>(IRQ3,IRQ4); 1=(IRQ3,IRQ4) > IRQ2.
D3
- Subgroup B - 0=IRQ3>IRQ4; 1=IRQ4>IRQ3.
D5
- Group C - 0=IRQ5>(IRQ6,IRQ7); 1=(IRQ6,IRQ7)>IRQ5.
D6
- Subgroup C - 0=IRQ6>IRQ7; 1=IRQ7>IRQ6.
相关PDF资料 |
PDF描述 |
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| IA88C00-PDW48I-R | Microcontroller |
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参数描述 |
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