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参数资料
| 型号： | ICS1524AMLFT |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 4/24页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN SSTL_3/PECL 24-SOIC |
| 产品变化通告： | Product Discontinuation 09/Feb/2012 |
| 标准包装： | 1,000 |
| 类型： | 时钟/频率合成器，时钟发生器，扇出配送 |
| PLL： | 是 |
| 输入： | LVTTL，晶体 |
| 输出： | PECL，SSTL-3 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:4 |
| 差分 - 输入:输出： | 无/是 |
| 频率 - 最大： | 250MHz |
| 除法器/乘法器： | 是/无 |
| 电源电压： | 3 V ~ 3.6 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 24-SOIC |
| 包装： | 带卷 (TR) |
| 其它名称： | 1524AMLFT |
ICS1524A
12
ICS1524A Rev F 05/13/10
Name:
Chip Version Register
Register:
10 h
Index:
Read
Bit Name
Bit #
Reset Value
Description
Chip Ver
0-7
17
Chip Version 24 (18h )
Name:
Chip Revision Register
Register:
11h
Index:
Read
Bit Name
Bit #
Reset Value
Description
Chip Rev
0 -7
01+
Initial value 01h.
+Value increments with each all-layer change.
Name:
Status Register
Register:
12 h
Index:
Read
Bit Name
Bit #
Reset Value
Description
DPA_Lock
0
N/A
DPA Lock Status
PLL_Lock
1
N/A
PLL Lock Status
Reserved
2 -7
0
Reserved
Bit
Name
Description
0
DPA_Lock
DPA Lock Status. (Refer to Register 0h, bits 6 and 7.)
0 = Unlocked
1 = Locked
1
PLL_Lock
PLL Lock Status. (Refer to Register 0h, bits 6 and 7.)
0 = Unlocked
1 = Locked
2 -7
Reserved
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PDF描述 |
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参数描述 |
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