参数资料
型号: ICS2059GI-02
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 27 MHz, VIDEO CLOCK GENERATOR, PDSO16
封装: 0.173 INCH, TSSOP-16
文件页数: 7/12页
文件大小: 309K
代理商: ICS2059GI-02
Clock Multiplier and Jitter Attenuator
MDS 2059-02 C
4
Revision 031605
Integrated Circuit Systems, Inc.
525 Race Street, San Jose, CA 95126 tel (408) 297-1201 www.icst.com
ICS2059-02
Referencing the External Component Schematic on
this page, the external loop filter is made up of the
components RZ, C1 and C2. RSET establishes PLL
charge pump current and therefore influences loop
filter characteristics.
Design aid tools for configuring the loop filter can be
found at www.icst.com, including on-line and PC-based
calculators.
External Component Schematic
Recommended Loop Filter Values Vs. Output Frequency Range Selection
Note: For SEL input pin programming: 0 = GND, 1 = VDD, M = Floating
13
4
12
5
11
VIN
8
9
10
SEL0
ISET
16
3
VDD
ICLK2
ICLK1
1
VDD
ISEL
14
2
7
GND
SEL1
CLK
GND
15
6
16-pin (173 mil) TSSOP
CHGP
X1
X2
R SET
C
L
C
L
Crystal
(Refer to Crystal
Tuning section)
C
S
R
S
P
SEL1 SEL0
Crystal
Multiplier
(N)
RSET
RS
CS
CP
Loop
Bandwidth
(-3dB point)
Damping
Factor
0
2592
180 k
820 k
0.47
F
1.8 nF
11.2 Hz
3.00
0
1
2430
120 k
560 k
0.68
F
3.3 nF
11.8 Hz
2.97
1
0
1728
330 k
680 k
0.68
F
3.9 nF
11.5 Hz
3.17
1
1716
330 k
680 k
0.68
F
3.9 nF
11.5 Hz
3.18
M0
128
120 k
330 k
1
F
3.3 nF
14.5 Hz
3.16
M1
1
1 M
22 k
1
F
3.3 nF
204.2 Hz
3.08
ICS2059-02
Clock Multiplier and Jitter Attenuator
TSD
IDT / ICS Clock Multiplier and Jitter Attenuator
ICS2059-02
4
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