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参数资料
| 型号： | ICS307G-03LF |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 270 MHz, OTHER CLOCK GENERATOR, PDSO16 |
| 封装： | 4.40 MM, 0.65 MM PITCH, ROHS COMPLIANT, MO-153, TSSOP-16 |
| 文件页数： | 3/12页 |
| 文件大小： | 344K |
| 代理商： | ICS307G-03LF |
SERIALLY PROGRAMMABLE CLOCK SOURCE
MDS 307-03 D
11
Revision 031406
In te gr ated Circuit Systems ● 525 Ra ce Street, San Jose, CA 9512 6 ● tel (4 08) 297 -1 201 ● www.icst.com
ICS307-03
AC Electrical Characteristics
VDD = 3.3 V ±5%, Ambient Temperature 0 to +70
° C, unless stated otherwise
Note 1: Measured with 15 pF load.
Note 2: Jitter performance will change depending on configuration settings.
Parameter
Symbol
Conditions
Min.
Typ.
Max.
Units
Input Frequency
FIN
Fundamental crystal
3
27
MHz
Clock
0.1
300
MHz
Clock Output Frequency
FOUT
5 pF load
0.0002
270
MHz
15 pF load
0.0002
200
MHz
Output Clock Rise/Fall Time
tR, tF
20 to 80% (5 pF load)
1.5
ns
Output Clock Duty Cycle
Output Divides <> 3
45
49-51
55
%
Output Divide = 3
40
60
%
Frequency Transition time
STROBE high to CLK
out
310
ms
One Sigma Clock Period Jitter
Note 2
50
ps
Maximum Absolute Jitter
tja
Deviation from mean,
Note 2
±120
ps
VCO Frequency
VCOF
100
730
MHz
Divider 1 Input
Output divider 1 = 2
(5 pF load)
540
MHz
Output divider 1 = 2
(15 pF load)
400
MHz
Output divider 1 = 3
(5 pF load)
720
MHz
Output divider 1 = 3
(15 pF load)
600
MHz
Output divider 1 = 38
~ 1029
570
MHz
All other Output
Divider 1 values
730
MHz
Divider 2 and 3 Inputs
Output divider 2, 3 = 2
(5 pF load)
540
MHz
Output divider 2, 3 = 2
(15 pF load)
400
MHz
Output divider 2, 3=12
440
MHz
Output divider 2, 3 =
16, 24, 28 and 32
500
MHz
All other Output
Divider 2 & 3 values
730
MHz
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