参数资料
型号: ICS843001AG-21LFT
厂商: IDT, Integrated Device Technology Inc
文件页数: 15/17页
文件大小: 0K
描述: IC SYNTHESIZER LVPECL 24-TSSOP
标准包装: 2,500
系列: HiPerClockS™, FemtoClock™
类型: 频率合成器
PLL: 带旁路
输入: 晶体
输出: LVCMOS,LVPECL,LVTTL
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 无/是
频率 - 最大: 700MHz
除法器/乘法器: 是/无
电源电压: 3.135 V ~ 3.465 V
工作温度: 0°C ~ 70°C
安装类型: 表面贴装
封装/外壳: 24-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 24-TSSOP
包装: 带卷 (TR)
其它名称: 843001AG-21LFT
ICS843001-21
FEMTOCLOCKS CRYSTAL-TO-3.3V LVPECL FREQUENCY SYNTHESIZER
IDT / ICS LVPECL FREQUENCY SYNTHESIZER
7
ICS843001AG-21 REV. AMARCH 15, 2007
AC Electrical Characteristics
Table 6. AC Characteristics, VCC = VCCA = VCCO_CMOS = VCCO_PECL = 3.3V ± 5%, TA = 0°C to 70°C
NOTE 1: Measured from the VCC/2 of the input to VCCO_CMOS/2 of the output.
NOTE 2: Phase jitter measured using a 19.44MHz quartz crystal.
NOTE 3: This parameter is defined in accordance with JEDEC Standard 65.
Typical Phase Noise at 622.08MHz
Parameter
Symbol
Test Conditions
Minimum
Typical
Maximum
Units
fOUT
Output Frequency
56
700
MHz
tPD
Propagation Delay;
NOTE 1
TEST_CLK to
REF_CLK
2.3
2.8
ns
tjit()
RMS Phase Jitter, (Random);
NOTE 2, 3
622.08MHz,
(12kHz – 20MHz)
0.80
ps
tVCO
PLL VCO Lock Range
560
700
MHz
tR / tF
Output
Rise/Fall Time
Q0, Q0
20% to 80%
200
500
ps
REF_CLK
20% to 80%
300
800
ps
odc
Output Duty Cycle
Q0, Q0
45
55
%
REF_CLK
44
56
%
OC-12 Filter
Phase Noise Result by adding a
Sonet OC-12 filter to raw data
Raw Phase Noise Data
622.08MHz
RMS Phase Jitter (Random)
12kHz to 20MHz = 0.80ps (typical)
N
o
ise
P
o
wer
d
Bc
Hz
0
-10
-20
-30
-40
-50
-60
-70
-80
-90
-100
-110
-120
-130
-140
-150
-160
-170
-180
-190
100
1k
10k
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1M
10M
100M
Offset Frequency (Hz)
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