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参数资料
型号： ICS8624BYILF
厂商： INTEGRATED DEVICE TECHNOLOGY INC
元件分类： 时钟及定时
英文描述： PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32
封装： 7 X 7 MM, 1.40 MM HEIGHT, LQFP-32
文件页数： 14/15页
文件大小： 511K
代理商： ICS8624BYILF
Integrated
Circuit
Systems, Inc.
ICS8624I
LOW SKEW, 1-TO-5
DIFFERENTIAL-TO-HSTL ZERO DELAY BUFFER
8624BYI
www.icst.com/products/hiperclocks.html
REV. B NOVEMBER 15, 2005
8
FIGURE 3A. ICS8624I HSTL ZERO DELAY BUFFER SCHEMATIC EXAMPLE
C11
0.01u
(U1-16)
CLK_SEL
(U1-17)
Zo = 50 Ohm
SEL1
(U1-32)
R4A
50
DIV_SEL[1:0] = 01
VDD
C4
0.1uF
Zo = 50 Ohm
R9
50
VDD=3.3V
CLK_SEL
R4B
50
C2
0.1uF
RU5
SP
VDDO=1.8V
SEL1
C7
0.1uF
VDDA
R2A
50
C1
0.1uF
RU3
1K
(U1-25)
(155.5 MHz)
VDD
R10
50
Zo = 50 Ohm
RD2
1K
R7
10
C16
10u
SP = Space (i.e. not intstalled)
R2B
50
Zo = 50 Ohm
Bypass capacitor located near the power pins
VDDO
PL
L
_
SEL
RD4
SP
155.5 MHz
SEL0
C6
0.1uF
PLL_SEL
3.3V
RU4
1K
VDD
LVHSTL_input
+
-
VDD
R8
50
(U1-24)
SEL0
RD5
1K
U1
8624
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
32
31
30
29
28
27
26
25
SEL0
SEL1
CLK0
nCLK0
CLK1
nCLK2
CLK_SEL
MR
VD
D
nF
B
_I
N
FB
_
IN
GN
D
GN
D
nQ
0
Q0
V
DDO
VDDO
nQ1
Q1
nQ2
Q2
nQ3
Q3
VDDO
VD
D
PL
L
_
SEL
V
DDA
GN
D
GN
D
Q4
nQ
4
V
DDO
VDDO
RU2
SP
RD3
SP
(U1-9)
3.3V PECL Driver
C5
0.1uF
LAYOUT GUIDELINE
The schematic of the ICS8624I layout example is shown in
Figure 3A. The ICS8624I recommended PCB board layout for
this example is shown in Figure 3B. This layout example is
used as a general guideline. The layout in the actual system
will depend on the selected component types, the density of
the components, the density of the traces, and the stack up
of the P.C. board.
INPUTS:
CLK/nCLK INPUT:
For applications not requiring the use of the differential input,
both CLK and nCLK can be left floating. Though not required,
but for additional protection, a 1k
Ω resistor can be tied from
CLK to ground.
LVCMOS CONTROL PINS:
All control pins have internal pull-ups or pull-downs; additional
resistance is not required but can be added for additional
protection. A 1k
Ω resistor can be used.
RECOMMENDATIONS FOR UNUSED INPUT AND OUTPUT PINS
OUTPUTS:
HSTL OUTPUT
All unused HSTL outputs can be left floating. We recommend
that there is no trace attached. Both sides of the differential
output pair should either be left floating or terminated.
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PDF描述
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ICS8633AF-01 8633 SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
ICS8633AF-01T 8633 SERIES, PLL BASED CLOCK DRIVER, 3 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
ICS8634BK-01T 8634 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC32
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参数描述
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