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参数资料
型号： ICS87322BYIT
元件分类： 时钟及定时
英文描述： 87322 SERIES, LOW SKEW CLOCK DRIVER, 15 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
封装： 10 X 10 MM, 1.40 MM HEIGHT, MS-026, LQFP-52
文件页数： 14/15页
文件大小： 1187K
代理商： ICS87322BYIT
87322BYI
www.icst.com/products/hiperclocks.html
REV. B JUNE 20, 2005
8
Integrated
Circuit
Systems, Inc.
ICS87322BI
LOW SKEW,
÷1/÷2,
3.3V LVPECL/ECL CLOCK GENERATOR
LVPECL CLOCK INPUT INTERFACE
The CLK /nCLK accepts LVPECL, CML, SSTL and other dif-
ferential signals. Both V
SWING and VOH must meet the VPP and
V
CMR input requirements. Figures 4A to 4E show interface ex-
amples for the HiPerClockS CLK/nCLK input driven by the
most common driver types. The input interfaces suggested
here are examples only. If the driver is from another vendor,
use their termination recommendation. Please consult with
the vendor of the driver component to confirm the driver ter-
mination requirements.
FIGURE 4A. HIPERCLOCKS CLK/nCLK INPUT DRIVEN
BY A
CML DRIVER
FIGURE 4B. HIPERCLOCKS CLK/nCLK INPUT DRIVEN
BY AN
SSTL DRIVER
FIGURE 4C. HIPERCLOCKS CLK/nCLK INPUT DRIVEN
BY A
3.3V LVPECL DRIVER
FIGURE 4D. HIPERCLOCKS CLK/nCLK INPUT DRIVEN
BY A
3.3V LVDS DRIVER
PCLK/nPCLK
2.5V
Zo = 60 Ohm
SSTL
HiPerClockS
PCLK
nPCLK
R2
120
3.3V
R3
120
Zo = 60 Ohm
R1
120
R4
120
2.5V
FIGURE 4E. HIPERCLOCKS CLK/nCLK INPUT DRIVEN
BY A
3.3V LVPECL DRIVER WITH AC COUPLE
HiPerClockS
PCLK
nPCLK
PCLK/nPCLK
3.3V
R2
50
R1
50
3.3V
Zo = 50 Ohm
CML
3.3V
Zo = 50 Ohm
3.3V
HiPerClockS
PCLK
nPCLK
R2
84
R3
125
Input
Zo = 50 Ohm
R4
125
R1
84
LVPECL
3.3V
Zo = 50 Ohm
C2
R2
1K
R5
100
Zo = 50 Ohm
3.3V
C1
R3
1K
LVDS
R4
1K
HiPerClockS
PCLK
nPCLK
R1
1K
Zo = 50 Ohm
3.3V
PC L K/n PCL K
3.3V
R5
100 - 200
3.3V
HiPerClockS
PCLK
nPCLK
R1
125
PCLK/nPCLK
R2
125
R3
84
C1
C2
Zo = 50 Ohm
R4
84
Zo = 50 Ohm
R6
100 - 200
3.3V LVPECL
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