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参数资料
型号： ICS87322BYIT
元件分类： 时钟及定时
英文描述： 87322 SERIES, LOW SKEW CLOCK DRIVER, 15 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP52
封装： 10 X 10 MM, 1.40 MM HEIGHT, MS-026, LQFP-52
文件页数： 15/15页
文件大小： 1187K
代理商： ICS87322BYIT
87322BYI
www.icst.com/products/hiperclocks.html
REV. B JUNE 20, 2005
9
Integrated
Circuit
Systems, Inc.
ICS87322BI
LOW SKEW,
÷1/÷2,
3.3V LVPECL/ECL CLOCK GENERATOR
FIGURE 5. ICS87322BI SCHEMATIC EXAMPLE
SCHEMATIC EXAMPLE
Figure 5 shows a schematic example of the ICS87322BI. In this
example, the CLK0/nCLK0 input is selected. The input is driven
by an LVPECL driver. All banks are set at ÷2. The decoupling
capacitors should be physically located near the power pin.
For ICS87322BI, the unused outputs can be left floating.
CLK_SEL
C1
0.1uF
R2
50
C2
0.1uF
RD4
SP
DIV_SELA
+
-
+
-
(U1-39)
3.3V
SP = Spare (i.e. not intstalled)
R3
50
(U1-40)
CLK_SEL
Bypass capacitors located near the power pins
(U1-1)
DIV_SELB
(U1-14)
DIV_SELA
(U1-30)
VCC
RU4
1K
(U1-47)
R8
50
DIV_SELC
DIV_SELD
RD6
SP
U1
ICS87322I
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
39
38
37
36
35
34
33
32
31
30
29
28
27
52
51
50
49
48
47
46
45
44
43
42
41
40
VCC
MR
DIV_SELA
DIV_SELB
CLK0
nCLK0
CLK_SEL
CLK1
nCLK1
nc
DIV_SELC
DIV_SELD
VEE
VC
C
O
nQ
D
5
QD
5
nQ
D
4
QD
4
nQ
D
3
QD
3
nQ
D
2
QD
2
nQ
D
1
QD
1
nQ
D
0
QD
0
VCCO
QC0
nQC0
QC1
nQC1
QC2
nQC2
QC3
nQC3
VCCO
nc
VCCO
VC
C
O
QA
0
nQ
A
0
QA
1
nQ
A
1
VC
C
O
QB
0
nQ
B
0
QB
1
nQ
B
1
QB
2
nQ
B
2
VC
C
O
C8
0.1uF
(U1-52)
VCC
RU6
1K
R4
50
Zo = 50
VCC
R5
50
C7
0.1uF
Zo = 50
DIV_SELC
DIV_SELD
R7
50
R6
50
C3
0.1uF
C5
0.1uF
RD5
SP
DIV_SELB
C4
0.1uF
RU3
SP
C6
0.1uF
R9
50
Zo = 50
RD7
SP
RU7
1K
LVPECL
Zo = 50
RD3
1K
RU5
1K
R1
50
(U1-27)
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PDF描述
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