参数资料
型号: ICS889872
厂商: Integrated Device Technology, Inc.
英文描述: DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
中文描述: 差分至LVDS缓冲器/除法瓦/内部终端
文件页数: 2/14页
文件大小: 649K
代理商: ICS889872
ICS889872
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
PRELIMINARY
IDT / ICS
LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
2
ICS889872AK REV. A AUGUST 22, 2007
Table 1. Pin Descriptions
NOTE:
Pullup
refers to internal input resistors. See Table 2,
Pin Characteristics,
for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
QB0, nQB0
Output
Differential output pair. Divide by 2, 4, 8, 16. Unused outputs must be
terminated with 100W across the pin (QB0/nQB0).
LVDS interface levels.
3, 4
QB1, nQB1
Output
Differential output pair. Divide by 2, 4, 8, 16. Unused outputs must be
terminated with 100W across the pin (QB1nQB1).
LVDS interface levels.
5, 6
QA, nQA
Output
Differential undivided output pair. LVDS interface levels.
7, 14
V
DD
Power
Power supply pins.
8
nRESET/
nDISABLE
Input
Pullup
Output reset and enable/disable pin. When LOW, resets the divider select,
and align Bank A and Bank B edges. In addition, when LOW, Bank A and
Bank B will be disabled. Input threshold is V
DD
/2V.
Includes a 37k
pullup resistor. LVTTL / LVCMOS interface levels.
Inverting differential LVPECL clock input. RT = 50
termination to V
T
.
Reference voltage for AC-coupled applications. Equal to V
DD
– 1.4V
(approx.). Maximum sink/source current is 0.5mA.
9
nIN
Input
10
V
REF_AC
Output
11
V
T
Input
Termination input. Leave pin floating.
12
IN
Input
Non-inverting LVPECL differential clock input.
RT = 50
termination to V
T
.
Power supply ground.
13
GND
Power
15, 16
S1, S0
Input
Pullup
Select pins. Logic HIGH if left unconnected (÷16 mode). S0 = LSB.
Input threshold is VDD/2. 37kW pullup resistor.
LVCMOS/LVTTL interface levels.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
R
PULLUP
Input Pullup Resistor
37
k
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