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参数资料
| 型号： | ICS889875AK |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 889875 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC16 |
| 封装： | 3 X 3 MM, 0.95 MM HEIGHT, MO-220, VFQFN-16 |
| 文件页数： | 1/15页 |
| 文件大小： | 1123K |
| 代理商： | ICS889875AK |
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER
W/INTERNAL TERMINATION
ICS889875
IDT / ICS LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
1
ICS889875AK REV. A FEBRUARY 13, 2008
General Description
The ICS889875 is a high speed Differential-to-
LVDS Buffer/Divider w/Internal Termination and is a
member of the HiPerClockS family of high
performance clock solutions from IDT. The
ICS889875 has a selectable ÷1, ÷2, ÷4, ÷8, ÷16
output dividers. The clock input has internal termination resistors,
allowing it to interface with several differential signal types while
minimizing the number of required external components. The
device is packaged in a small, 3mm x 3mm VFQFN package,
making it ideal for use on space-constrained boards.
Features
Two LVDS outputs
Frequency divide select options: ÷1, ÷2, ÷4, ÷8, ÷16
IN, nIN input can accept the following differential input levels:
LVPECL, LVDS, CML
Output frequency: >2GHz
Cycle-to-cycle jitter: 1ps RMS (maximum)
Total jitter: 10ps (typical)
Output skew: 15ps (maximum)
Part-to-part skew: 280ps (maximum)
Propagation Delay: 1140ps (maximum)
Full 2.5V supply mode
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
HiPerClockS
ICS
ICS889875
16-Lead VFQFN
3mm x 3mm x 0.925mm package body
K Package
Top View
Block Diagram
Pin Assignment
Decoder
50
50
Enable
FF
÷2, ÷4,
÷8, ÷16
Enable
MUX
Q0
nQ0
Q1
nQ1
nRESET/
nDISABLE
IN
V
T
V
REF_AC
S1
S0
S2
nIN
Pullup
5
6
7
8
16 15 14 13
1
2
3
4
12
11
10
9
Q0
nQ0
Q1
nQ1
IN
VT
VREF_AC
nIN
S2
nc
V
DD
nRESET/
nDISABLE
S1
V
DD
GND
S0
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