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参数资料
| 型号： | ICS889875AK |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 889875 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC16 |
| 封装： | 3 X 3 MM, 0.95 MM HEIGHT, MO-220, VFQFN-16 |
| 文件页数： | 8/15页 |
| 文件大小： | 1123K |
| 代理商： | ICS889875AK |
ICS889875
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
IDT / ICS LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
2
ICS889875AK REV. A FEBRUARY 13, 2008
Table 1. Pin Descriptions
NOTE: Pullup refers to internal input resistors. See Table 2, Pin Characteristics, for typical values.
Table 2. Pin Characteristics
Number
Name
Type
Description
1, 2
Q0, nQ0
Output
Differential output pair. Divide by 1, 2, 4, 8, or 16. Unused outputs must be
terminated with 100
across the differential pair.
LVDS interface levels.
3, 4
Q1, nQ1
Output
Differential output pair. Divide by 1, 2, 4, 8, or 16. Unused outputs must be
terminated with 100
across the differential pair.
LVDS interface levels.
5, 15, 16
S2, S1, S0
Input
Pullup
Select pins. Internal 37k
pullup resistor. Logic HIGH if left disconnected.
Input threshold is VDD/2. LVCMOS/LVTTL interface levels.
6
nc
Unused
No connect.
7, 14
VDD
Power
Power supply pins.
8
nRESET/
nDISABLE
Input
Pullup
Synchronizing enable/disable pin. When LOW, resets the divider (divided by
1, 2, 4, 8 or 16 mode). When HIGH, disconnected. The reset and disable
function occurs on the next high-to-low clock input transition.
Input threshold is VDD/2V. Includes a 37k pull-up resistor.
LVTTL / LVCMOS interface levels.
9
nIN
Input
Inverting differential LVPECL clock input. RT = 50 termination to VT.
10
VREF_AC
Output
Reference voltage for AC-coupled applications. Equal to VDD – 1.4V
(approx.). Maximum sink/source current is 0.5mA.
11
VT
Input
Termination center-tap input. Leave pin floating.
12
IN
Input
Non-inverting LVPECL differential clock input.
RT = 50 termination to VT.
13
GND
Power
Power supply ground.
Symbol
Parameter
Test Conditions
Minimum
Typical
Maximum
Units
RPULLUP
Input Pullup Resistor
37
k
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