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参数资料
| 型号： | ICS889875AK |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 889875 SERIES, LOW SKEW CLOCK DRIVER, 2 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), QCC16 |
| 封装： | 3 X 3 MM, 0.95 MM HEIGHT, MO-220, VFQFN-16 |
| 文件页数： | 14/15页 |
| 文件大小： | 1123K |
| 代理商： | ICS889875AK |
ICS889875
DIFFERENTIAL-TO-LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
IDT / ICS LVDS BUFFER/DIVIDER W/INTERNAL TERMINATION
8
ICS889875AK REV. A FEBRUARY 13, 2008
Application Information
Wiring the Differential Input to Accept Single Ended Levels
Figure 2 shows how the differential input can be wired to accept
single ended levels. The reference voltage V_REF = VDD/2 is
generated by the bias resistors R1, R2 and C1. This bias circuit
should be located as close as possible to the input pin. The ratio of
R1 and R2 might need to be adjusted to position the V_REF in the
center of the input voltage swing. For example, if the input clock
swing is only 2.5V and VDD = 3.3V, V_REF should be 1.25V and
R2/R1 = 0.609.
Figure 2. Single-Ended Signal Driving Differential Input
Recommendations for Unused Input Pins
Inputs:
LVCMOS Select Pins
All control pins have internal pull-ups; additional resistance is not
required but can be added for additional protection. A 1k
resistor
can be used.
OUTputs:
LVDS Outputs
All unused LVDS output pairs can be either left floating or
terminated with 100
across. If they are left floating, we
recommend that there is no trace attached.
Single Ended Clock Input
VDD
IN
nIN
R1
C1
0.1u
R2
1K
V_REF
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