参数资料
型号: ICS932S401YFLF-T
厂商: INTEGRATED DEVICE TECHNOLOGY INC
元件分类: 时钟产生/分配
英文描述: 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
封装: ROHS COMPLIANT, MO-118, SSOP-56
文件页数: 9/23页
文件大小: 204K
代理商: ICS932S401YFLF-T
17
Integrated
Circuit
Systems, Inc.
ICS932S401
0921F—06/13/07
SMBus Table: CPU Programmable Output Divider Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
CPUDiv3
RW
X
Bit 6
CPUDiv2
RW
X
Bit 5
CPUDiv1
RW
X
Bit 4
CPUDiv0
RW
X
Bit 3
X
Bit 2
X
Bit 1
X
Bit 0
X
SMBus Table: SRC and PCI Programmable Output Divider Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
PCIDiv3
RW
X
Bit 6
PCIDiv2
RW
X
Bit 5
PCIDiv1
RW
X
Bit 4
PCIDiv0
RW
X
Bit 3
SRC_Div3
RW
X
Bit 2
SRC_Div2
RW
X
Bit 1
SRC_Div1
RW
X
Bit 0
SRC_Div0
RW
X
SMBusTable: Test Byte Register
Test
Type
PWD
Bit 7
RW
0
Bit 6
RW
0
Bit 5
RW
0
Bit 4
RW
0
Bit 3
RW
0
Bit 2
RW
0
Bit 1
RW
0
Bit 0
RW
0
Note: Do NOT write to Bit 21. Erratic device operation will result!
Byte 19
Byte 20
-
See CPU, SRC and PCI
Divider Ratios Table
See CPU, SRC and PCI
Divider Ratios Table
RESERVED
CPU Divider Ratio Programming Bits
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
ICS ONLY TEST
Reserved
Test Function
Test Result
`
ICS ONLY TEST
Reserved
Byte 21
-
SRC_ Divider Ratio Programming Bits
-
PCI Divider Ratio Programming Bits
-
See CPU, SRC and PCI
Divider Ratios Table
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