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参数资料
| 型号： | ICS93725YFLFT |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 19 TRUE OUTPUT(S), 6 INVERTED OUTPUT(S), PDSO48 |
| 封装： | 0.300 INCH, MO-118, SSOP-48 |
| 文件页数： | 5/8页 |
| 文件大小： | 66K |
| 代理商： | ICS93725YFLFT |
5
ICS93725
0606A—08/01/03
Electrical Characteristics - Input/Supply/Common Output Parameters
SEL_DDR=1 DDR Outputs VDD=2.5V, TA=0 - 85°C; (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
100MHz, RL=0
, CL = 0pF
141
mA
133MHz, RL=0
, CL = 0pF
188
mA
200MHz, RL=0
, CL = 0pF
271
mA
Output High Current
IOH
VDD=2.5V, VOUT=1V
-43
-18
mA
Output Low Current
IOL
VDD=2.5V, VOUT=1.2V
26
38
mA
VDD=2.5V
IOH = -12 mA
VDD=2.5V
IOH = 12 mA
Output differential-pair
VDD = 2.5V
Crossing voltage
100/133/166/ 200 Mhz
Input Capacitance
1
CIN
VI = GND or VDD
2pF
1Guaranteed by design, not 100% tested in production.
VOH
1.7
IDD2.5
Operating Supply Current
2V
Low-level output voltage
VOL
0.4
0.6
V
High-level output voltage
1.45
V
VOC
1.05
1.25
Recommended Operating Condition
SEL_DDR=1 DDR Outputs VDD=2.5V, TA=0 - 85°C; (unless otherwise stated)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
Power Supply Voltage
VDD2.5
2.3
2.5
2.7
V
Input High Voltage
VIH
SEL_DDR, PD# input
2
V
Input Low Voltage
VIL
SEL_DDR, PD# input
0.8
V
Input Voltage Level
VIN
02.5
2.7
V
1Guaranteed by design, not 100% tested in production.
相关PDF资料 |
PDF描述 |
|---|---|
| ICS93727YFLF-T | PLL BASED CLOCK DRIVER, 10 TRUE OUTPUT(S), 10 INVERTED OUTPUT(S), PDSO48 |
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| ICS9502P | Industrial Control IC |
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| ICSS1002V4 | Communications Interface |
相关代理商/技术参数 |
参数描述 |
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