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参数资料
| 型号： | ICS952702YFLFT |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟产生/分配 |
| 英文描述： | 222 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48 |
| 封装： | LEAD FREE, MO-118, SSOP-48 |
| 文件页数： | 16/17页 |
| 文件大小： | 149K |
| 代理商： | ICS952702YFLFT |
8
Integrated
Circuit
Systems, Inc.
ICS952702
0795D—05/06/05
I
2C Table: Slew Rate Control Register
Bit 7
PCIStr1
RW
1
Bit 6
PCIStr0
RW
1
Bit 5
PCIStr1
RW
1
Bit 4
PCIStr0
RW
1
Bit 3
PCIStr1
RW
1
Bit 2
PCIStr0
RW
1
Bit 1
AGPStr1
RW
1
Bit 0
AGPStr0
RW
1
I
2C Table: Reserved Register
Bit 7
Reserved
R
-
1
Bit 6
Reserved
R
-
1
Bit 5
Reserved
R
-
1
Bit 4
Reserved
R
-
1
Bit 3
Reserved
R
-
1
Bit 2
Reserved
R
-
1
Bit 1
Reserved
R
-
1
Bit 0
Reserved
R
-
1
I
2C Table: Byte Count Register
Bit 7
BC7
RW
-
0
Bit 6
BC6
RW
-
0
Bit 5
BC5
RW
-
0
Bit 4
BC4
RW
-
0
Bit 3
BC3
RW
-
1
Bit 2
BC2
RW
-
1
Bit 1
BC1
RW
-
1
Bit 0
BC0
RW
-
1
I
2C Table: Watchdog Timer Control Register
Pin #
Name
Control Function
Type
0
1
PWD
Bit 7
WDSA control
WD soft alarm control
RW
Disable
Enable
0
Bit 6
WDHRB
WD Hard Alarm Status
Read back
RNormal
Alarm
X
Bit 5
WDSRB
WD Soft Alarm Status
Read back
RNormal
Alarm
X
Bit 4
GR_EN
Gear Shift Reset Enable
RW
Disable
Enable
0
Bit 3
WDTCtrl
Watch Dog Time base
control
RW
290ms base
1160ms base
0
Bit 2
WD2
WD Timer Bit2
RW
1
Bit 1
WD1
WD Timer Bit1
RW
1
Bit 0
WD0
WD Timer Bit0
RW
1
AGPCLK Strength
Control
00=.7x; 01=.8x; 10=.9x; 11=1x Strength
PCICLK(2:0) Strength
Control
00=.63x; 01=.75x; 10=.88x; 11=1x
Strength
PCICLK(5:3) Strength
Control
00=.63x; 01=.75x; 10=.88x; 11=1x
Strength
PCICLK_F(1:0) Strength
Control
00=.63x; 01=.75x; 10=.88x; 11=1x
Strength
PWD
01
PWD
1
0
1
0
Byte 9
-
Name
-
Byte 7
Pin #
-
Type
Control Function
-
Byte 6
Pin #
Name
-
Type
-
Control Function
Byte 8
Pin #
Name
Writing to this register will
configure how many
bytes will be read back,
default is 0F = 15 bytes.
-
These bits represent X*290ms (or
1.16S) the watchdog timer will wait
before it goes to alarm mode. Default is
7 X 290ms =2s.
Control Function
Type
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PDF描述 |
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