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参数资料
| 型号： | ICS9DB206YFT |
| 元件分类： | 时钟及定时 |
| 英文描述： | PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28 |
| 封装： | 0.209 INCH, MO-150, SSOP-28 |
| 文件页数： | 2/7页 |
| 文件大小： | 94K |
| 代理商： | ICS9DB206YFT |
2
Integrated
Circuit
Systems, Inc.
ICS9DB206
Advance Information
0835—07/24/03
Pin Description
PIN
#
PIN NAME
PIN TYPE
DESCRIPTION
1
PLL_BW
IN
3.3V input for selecting PLL Band Width
0 = low, 1= high
2
CLK_INT
IN
"True" reference clock input.
3
CLK_INC
IN
"Complimentary" reference clock input.
4
FS0
IN
Frequency select pin.
5
PCIEXT0
OUT
True clock of differential PCI_Express pair.
6
PCIEXC0
OUT
Complement clock of differential PCI_Express pair.
7
VDD
PWR
Power supply, nominal 3.3V
8
GND
IN
Ground pin.
9
PCIEXT1
OUT
True clock of differential PCI_Express pair.
10
PCIEXC1
OUT
Complement clock of differential PCI_Express pair.
11
PCIEXT2
OUT
True clock of differential PCI_Express pair.
12
PCIEXC2
OUT
Complement clock of differential PCI_Express pair.
13
VDD
PWR
Power supply, nominal 3.3V
14
OE0
IN
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
15
OE1
IN
Active high input for enabling outputs.
0 = tri-state outputs, 1= enable outputs
16
VDD
PWR
Power supply, nominal 3.3V
17
PCIEXC3
IN
Complement clock of differential PCI_Express pair.
18
PCIEXT3
OUT
True clock of differential PCI_Express pair.
19
PCIEXC4
OUT
Complement clock of differential PCI_Express pair.
20
PCIEXT4
OUT
True clock of differential PCI_Express pair.
21
GND
PWR
Ground pin.
22
VDD
PWR
Power supply, nominal 3.3V
23
PCIEXC5
OUT
Complement clock of differential PCI_Express pair.
24
PCIEXT5
OUT
True clock of differential PCI_Express pair.
25
FS1
IN
Frequency select pin.
26
IREF
OUT
This pin establishes the reference current for the differential current-
mode output pairs. This pin requires a fixed precision resistor tied
to ground in order to establish the appropriate current. 475 ohms is
the standard value.
27
GNDA
PWR
Ground pin for the PLL core.
28
VDDA
PWR
3.3V power for the PLL core.
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