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参数资料
型号： ICS9DB206YFT
元件分类： 时钟及定时
英文描述： PLL BASED CLOCK DRIVER, 6 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO28
封装： 0.209 INCH, MO-150, SSOP-28
文件页数： 5/7页
文件大小： 94K
代理商： ICS9DB206YFT
5
Integrated
Circuit
Systems, Inc.
ICS9DB206
Advance Information
0835—07/24/03
Electrical Characteristics - PCIEX Current Mode Differential Pair
TA = 0 - 70°C; VDD = 3.3 V +/-5%; CL =2pF
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
MAX
UNITS
NOTES
Current Source Output
Impedance
Zo
1
VO = Vx
3000
1
Output High Voltage
VOH3
IOH = -1 mA
2.4
V
Output Low Voltage
VOL3
IOL = 1 mA
0.4
Voltage High
VHigh
660
850
1
Voltage Low
VLow
-150
150
1
Max Voltage
Vovs
1150
1
Min Voltage
Vuds
-300
1
Crossing Voltage (abs)
Vcross(abs)
250
550
mV
1
Crossing Voltage (var)
d-Vcross
Variation of crossing over all
edges
140
mV
1
Long Accuracy
ppm
see Tperiod min-max values
-300
300
ppm
1,2
250 MHz nominal
3.9880
4.0120
ns
2
200 MHz nominal
4.9985
5.0015
ns
2
166.66 MHz nominal
5.9982
6.0018
ns
2
133.33 MHz nominal
7.4978
7.5023
ns
2
100.00 MHz nominal
9.9970
10.0030
ns
2
250 MHz nominal
TBD
ns
1,2
200 MHz nominal
4.8735
ns
1,2
166.66 MHz nominal
5.8732
ns
1,2
133.33 MHz nominal
7.3728
ns
1,2
100.00 MHz nominal
9.8720
ns
1,2
Rise Time
tr
VOL = 0.175V, VOH = 0.525V
175
700
ps
1
Fall Time
tf
VOH = 0.525V VOL = 0.175V
175
700
ps
1
Rise Time Variation
d-tr
125
ps
1
Fall Time Variation
d-tf
125
ps
1
Duty Cycle
dt3
Measurement from differential
wavefrom
45
55
%
1
Skew
tsk3
VT = 50%
50
ps
1
Jitter, Cycle-to-Cycle
tcyc
Measured from differential
waveform in ZDB mode.
TBD
ps
1
Jitter, Phase
tphase
Measured from differential
waveform in ZDB mode. Phase
noise mask is TBD
-15
15
ps
1
1Guaranteed by design, not 100% tested in production.
2 All Long Term Accuracy and Clock Period specifications are guaranteed with the assumption that Clock Input is
at its nominal frequency +/- 300 ppm
Average period
Tperiod
Statistical measurement on
single ended signal using
oscilloscope math function.
mV
Measurement on single ended
signal using absolute value.
mV
Absolute min period
Tabsmin
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