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参数资料
| 型号： | ICSSSTUAF32866C |
| 厂商： | Integrated Device Technology, Inc. |
| 英文描述： | 25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2 |
| 中文描述： | 25位可配置注册缓冲内存 |
| 文件页数： | 19/31页 |
| 文件大小： | 562K |
| 代理商： | ICSSSTUAF32866C |
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ICSSSTUAF32866C
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
19
ICSSSTUAF32866C
7100/9
Register Timing
Timing Diagram for SSTUAF32866C Used as a Single Device; C0 = 0, C1 = 0, RESET Switches from H to L
NOTE:
1.After RESET is switched from HIGH to LOW, all data and clock inputs signals must be set and held at valid logic levels (not floating) for a minimum time
of t
INACTMAX
.
CLK
CLK
CSR
DCS
RESET
t
INACT
H, L, or X
H or L
t
RPHL
RESET to PPO
t
RPHL
RESET to Q
D1 - D25
PARIN
QERR
Q1 - Q25
(1)
(1)
PPO
t
RPLH
RESET to QERR
(1)
(1)
(1)
(1)
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PDF描述 |
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