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参数资料
| 型号： | IDT5T905PGGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 4/19页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF 1:5 250MHZ 28-TSSOP |
| 标准包装： | 50 |
| 类型： | 扇出缓冲器（分配） |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:5 |
| 差分 - 输入:输出： | 是/无 |
| 输入： | eHSTL，HSTL，LVPECL，LVTTL |
| 输出： | eHSTL，HSTL，LVTTL |
| 频率 - 最大： | 250MHz |
| 电源电压： | 2.4 V ~ 2.6 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 28-TSSOP |
| 包装： | 管件 |
| 其它名称： | 5T905PGGI 800-2433-5 IDT5T905PGGI-ND |
INDUSTRIALTEMPERATURERANGE
12
IDT5T905
2.5VSINGLEDATARATE1:5CLOCKBUFFERTERABUFFER
AC ELECTRICAL CHARACTERISTICS OVER OPERATING RANGE(6)
Symbol
Parameter
Min.
Typ.
Max
Unit
Skew Parameters
tSK(O)
Same Device Output Pin-to-Pin Skew(1)
Single-EndedandDifferentialModes
—
60
ps
Single-EndedinDifferentialMode(DSE)
—
60
—
tSK(P)(2)
Pulse Skew(3)
Single-EndedandDifferentialModes
——
300
ps
Single-EndedinDifferentialMode(DSE)
—
300
—
dT(4)
Duty Cycle
40
—
60
%
tSK(PP)
Part-to-PartSkew(5)
Single-EndedandDifferentialModes
——
300
ps
Single-EndedinDifferentialMode(DSE)
—
300
—
Propagation Delay
tPLH
Propagation Delay A to Qn
——
2.5
ns
tPHL
tR
Output Rise Time (20% to 80%)
2.5V / 1.8V LVTTL Outputs
350
—
1050
ps
HSTL / eHSTL Outputs
350
—
1350
tF
Output Fall Time (20% to 80%)
2.5V / 1.8V LVTTL Outputs
350
—
1050
ps
HSTL / eHSTL Outputs
350
—
1350
fO
FrequencyRange(HSTL/eHSTLoutputs)
——
250
MHz
FrequencyRange(2.5V/1.8VLVTTLoutputs)
——
200
OutputGateEnable/DisableDelay
tPGE
OutputGateEnabletoQn
——
3.5
ns
tPGD
Output Gate Enable to Qn Driven to GL Designated Level
——
3ns
NOTES:
1. Skew measured between all outputs under identical input and output interfaces, transitions, and load conditions on any one device.
2. For only 1.8V/2.5V LVTTL and eHSTL outputs.
3. Skew measured is difference between propagation times tPLH and tPHL of any output under identical input and output interfaces, transitions, and load conditions on any one device.
4. For only HSTL outputs.
5. Skew measured is the magnitude of the difference in propagation times between any outputs of two devices, given identical transitions and load conditions at identical VDD/VDDQ
levels and temperature.
6. Guaranteed by design.
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PDF描述 |
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参数描述 |
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