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参数资料
型号： IDT70T3719MS133BBG
厂商： IDT, Integrated Device Technology Inc
文件页数： 1/25页
文件大小： 0K
描述： IC SRAM 18MBIT 133MHZ 324BGA
标准包装： 1
格式 - 存储器： RAM
存储器类型： SRAM - 双端口，同步
存储容量： 18M（256K x 72）
速度： 133MHz
接口： 并联
电源电压： 2.4 V ~ 2.6 V
工作温度： 0°C ~ 70°C
封装/外壳： 324-BGA
供应商设备封装： 324-PBGA（19x19）
包装： 托盘
其它名称： 70T3719MS133BBG
HIGH-SPEED 2.5V
256/128K x 72
SYNCHRONOUS
DUAL-PORT STATIC RAM
IDT70T3719/99M
Features:
WITH 3.3V OR 2.5V INTERFACE
◆
◆
True Dual-Port memory cells which allow simultaneous
access of the same memory location
High-speed data access
– 1.7ns setup to clock and 0.5ns hold on all control, data, and
address inputs @ 166MHz
– Data input, address, byte enable and control registers
– Commercial: 3.6ns (166MHz)/
4.2ns (133MHz)(max.)
– Industrial: 4.2ns (133MHz) (max.)
◆
◆
Separate byte controls for multiplexed bus and bus
matching compatibility
Dual Cycle Deselect (DCD) for Pipelined Output Mode
◆
◆
◆
◆
◆
Selectable Pipelined or Flow-Through output mode
Counter enable and repeat features
Dual chip enables allow for depth expansion without
additional logic
Interrupt and Collision Detection Flags
Full synchronous operation on both ports
– 6ns cycle time, 166MHz operation (23.9Gbps bandwidth)
– Fast 3.6ns clock to data out
– Self-timed write allows fast cycle time
◆
◆
◆
◆
◆
◆
2.5V (±100mV) power supply for core
LVTTL compatible, selectable 3.3V (±150mV) or 2.5V
(±100mV) power supply for I/Os and control signals on
each port
Industrial temperature range (-40°C to +85°C) is
available at 133MHz
Available in a 324-pin Green Ball Grid Array (BGA)
Includes JTAG Functionality
Green parts available, see ordering information
Functional Block Diagram
BE 7L
BE 0L
BE 7R
BE 0R
FT /PIPE L
1/0
0a 1a
0h 1h
1h 0h
1a 0a
1/0
FT /PIPE R
R/ W L
CE 0L
a
h
h
a
R/ W R
CE 0R
CE 1L
1
0
1
0
CE 1R
OE L
1/0
B
W
0
L
B
W
7
L
B
W
7
R
B
W
0
R
1/0
OE R
D OUT 0-8_L
D OUT 9-17_L
D O UT 18-26_L
D OUT 27-35_L
D OUT 36-44_L
D OUT 45-53_L
D OUT 54-62_L
D OUT 0-8_R
D OUT 9-17_R
D OUT 18-26_R
D OUT 27-35_R
D OUT 36-44_R
D OUT 45-53_R
D OUT 54-62_R
1h 0h
1a 0a
D OUT 63-72_L
D OUT 63-72_R
0a 1a
0h 1h
,
FT /PIPE L
0/1
0/1
FT /PIPE R
a
h
h
a
256/128K x 72
MEMORY
ARRAY
Byte 0
I/O 0L - I/O 71L
CLK L
A 17L (1)
Byte 7
D IN _L
D IN _R
Byte 7
Byte 0
I/O 0R - I/O 71R
CLK R
A 17R (1)
,
A 0L
REPEAT L
ADS L
CNTEN L
Counter/
Address
Reg.
ADDR_L
ADDR_R
Counter/
Address
Reg.
A 0 R
REPEAT R
ADS R
CNTEN R
CE 0L
CE 1L
R/ W L
INTERRUPT
COLLISION
DETECTION
LOGIC
R/ W R
CE 0R
CE 1R
TDI
TDO
JTAG
TCK
TMS
TRST
COL L
INT L
COL R
INT R
ZZ L
NOTES:
(2)
ZZ
CONTROL
LOGIC
ZZ R
(2)
5687 drw 01
1. Address A 17 is a NC for the IDT70T3799.
2. The sleep mode pin shuts off all dynamic inputs, except JTAG inputs, when asserted. All static inputs, i.e., PL/ FT x and OPTx
and the sleep mode pins themselves (ZZx) are not affected during sleep mode.
1
?2009 Integrated Device Technology, Inc.
JANUARY 2009
DSC 5687/2
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PDF描述
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