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参数资料
| 型号： | IDT72605L25J8 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 5/17页 |
| 文件大小： | 0K |
| 描述： | IC FIFO BI SYNC 256X18 68-PLCC |
| 标准包装： | 250 |
| 系列： | 7200 |
| 功能： | 同步 |
| 存储容量： | 9.2K（512 x 18） |
| 数据速率： | 40MHz |
| 访问时间： | 25ns |
| 电源电压： | 4.5 V ~ 5.5 V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 68-LCC（J 形引线） |
| 供应商设备封装： | 68-PLCC（24x24） |
| 包装： | 带卷 (TR) |
| 其它名称： | 72605L25J8 |
13
IDT72605/72615 CMOS SYNCBiFIFO
256 x 18x 2 and 512 x 18 x 2
INDUSTRIALTEMPERATURERANGE
DATA INPUT
BYPASS FLAG
tSKEW1
CLKB
ENB
R/
WB
FFAB
DA0-DA17
CLKA
tCS
OEB
tA
tOE
tOLZ
R/
WA
DB0-DB17
ENA
A0, A1, A2
tDS
2704 drw 13
CSA
EFAB
BYPB
A2, A1, A0 = 001
tFF
tCH
tCS
tFF
tEF
tOHZ
DATA OUTPUT
FIFO FLAG
BYPASS FLAG
FIFO FLAG
tSKEW1
tCH
NOTES:
1. When CSA is brought HIGH, A
→B Bypass mode will switch to FIFO mode on the following CLKA LOW-to-HIGH transition.
2. After the bypass operation is completed, the BYPB goes from LOW-to-HIGH; this will reset all bypass flags. The bypass path becomes available for the next bypass
operation.
3. When A-side changed from bypass mode into FIFO mode, B-side only has one cycle to read the bypass data. On the next cycle, B-side will be forced back to FIFO
mode.
Figure 10. A
→
→B Bypass Timing
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PDF描述 |
|---|---|
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参数描述 |
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