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参数资料
| 型号： | IDT74ALVCHR16501PA8 |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 总线收发器 |
| 英文描述： | ALVC/VCX/A SERIES, 18-BIT REGISTERED TRANSCEIVER, TRUE OUTPUT, PDSO56 |
| 封装： | TSSOP-56 |
| 文件页数： | 5/7页 |
| 文件大小： | 74K |
| 代理商： | IDT74ALVCHR16501PA8 |
INDUSTRIALTEMPERATURERANGE
IDT74ALVCHR16501
3.3VCMOS18-BITUNIVERSALBUSTRANSCEIVERWITH3-STATEOUTPUTS
5
NOTES:
1.
See TEST CIRCUITS AND WAVEFORMS. TA = – 40°C to + 85°C.
2
Skew between any two outputs of the same package and switching in the same direction.
SWITCHING CHARACTERISTICS(1)
VCC = 2.5V ± 0.2V
VCC = 2.7V
VCC = 3.3V ± 0.3V
Symbol
Parameter
Min.
Max.
Min.
Max.
Min.
Max.
Unit
tPLH
PropagationDelay
1.2
5.9
—
5.2
1
4.5
ns
tPHL
Ax to Bx or Bx to Ax
tPLH
PropagationDelay
1.6
6.8
—
6
1.3
5.2
ns
tPHL
LEBA to Ax or LEAB to Bx
tPLH
PropagationDelay
1.7
7.2
—
6.3
1.4
5.5
ns
tPHL
CLKBA to Ax or CLKAB to Bx
tPZH
OutputEnableTime
1.4
7.3
—
6.7
1.1
5.6
ns
tPZL
OEBA to Ax
tPZH
OutputEnableTime
1.1
6.8
—
6
1
5.2
ns
tPZL
OEAB to Bx
tPHZ
OutputDisableTime
2
6
—
5.1
1.3
4.7
ns
tPLZ
OEBA to Ax
tPHZ
OutputDisableTime
2.2
6.9
—
6.2
1.4
5.5
ns
tPLZ
OEAB to Bx
tSU
Set-up Time, data before CLK
↑
2.2
—
2.1
—
1.7
—
ns
tH
Hold Time, data after CLK
↑
0.6
—
0.6
—
0.7
—
ns
tSU
Set-up Time, data before LE
↓
CLK LOW
1.9
—
1.6
—
1.5
—
ns
CLK HIGH
1.3
—
1.1
—
1
—
tH
Hold Time, data after LE
↓, CLK HIGH or LOW
1.4
—
1.7
—
1.4
—
ns
tW
Pulse Width, LE HIGH
3.3
—
3.3
—
3.3
—
ns
tW
Pulse Width, CLK HIGH or LOW
3.3
—
3.3
—
3.3
—
ns
tSK(o)
Output Skew(2)
—
500
ps
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PDF描述 |
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