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参数资料
| 型号： | IDT79RC32H434-266BCGI |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 26/53页 |
| 文件大小： | 0K |
| 描述： | IC MPU 32BIT CORE 266MHZ 256-BGA |
| 标准包装： | 90 |
| 系列： | Interprise™ |
| 处理器类型： | MIPS32 32-位 |
| 速度： | 266MHz |
| 电压： | 1.2V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 256-LBGA |
| 供应商设备封装： | 256-CABGA（17x17） |
| 包装： | 托盘 |
| 其它名称： | 79RC32H434-266BCGI |
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January 19, 2006
IDT RC32434
Figure 18 SPI AC Timing Waveform — Bit I/O Mode
Signal
Symbol Reference
Edge
266MHz
300MHz
350MHz
400MHz
Unit Condi-
tions
Timing
Diagram
Reference
Min
Max
Min
Max
Min
Max
Min
Max
EJTAG and JTAG
JTAG_TCK
Tper_16a
none
25.0
50.0
25.0
50.0
25.0
50.0
25.0
50.0
ns
See Figure 19.
Thigh_16a,
Tlow_16a
10.0
25.0
10.0
25.0
10.0
25.0
10.0
25.0
ns
JTAG_TMS1,
JTAG_TDI
1. The JTAG specification, IEEE 1149.1, recommends that both JTAG_TMS and EJTAG_TMS should be held at 1 while the signal applied at JTAG_TRST_N changes from 0 to 1.
Otherwise, a race may occur if JTAG_TRST_N is deasserted (going from low to high) on a rising edge of JTAG_TCK when either JTAG_TMS or EJTAG_TMS is low, because the
TAP controller might go to either the Run-Test/Idle state or stay in the Test-Logic-Reset state.
Tsu_16b
JTAG_TCK
rising
2.4
—
2.4
—
2.4
—
2.4
—
ns
Thld_16b
1.0
—
1.0
—
1.0
—
1.0
—
ns
JTAG_TDO
Tdo_16c
JTAG_TCK fall-
ing
—
11.3
—
11.3
—
11.3
—
11.3
ns
Tdz_16c2
2. The values for this symbol were determined by calculation, not by testing.
—
11.3
—
11.3
—
11.3
—
11.3
ns
JTAG_TRST_
N
Tpw_16d2
none
25.0
—
25.0
—
25.0
—
25.0
—
ns
EJTAG_TMS1 Tsu_16e
JTAG_TCK
rising
2.0
—
2.0
—
2.0
—
2.0
—
ns
Thld_6e
1.0
—
1.0
—
1.0
—
1.0
—
ns
Table 14 JTAG AC Timing Characteristics
SCK, SDI, SDO (input)
Tpw_15e
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PDF描述 |
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