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参数资料
| 型号： | IS61VF102436A-6.5B3I |
| 厂商： | INTEGRATED SILICON SOLUTION INC |
| 元件分类： | SRAM |
| 英文描述： | 1M X 36 CACHE SRAM, 6.5 ns, PBGA165 |
| 封装： | 13 X 15 MM, PLASTIC, BGA-165 |
| 文件页数： | 17/20页 |
| 文件大小： | 386K |
| 代理商： | IS61VF102436A-6.5B3I |
6
Integrated Silicon Solution, Inc.
Rev. B
04/17/08
IS61LF102436A IS61LF204818A
IS61VF102436A IS61VF204818A
PIN CONFIGURATION
DQPb
DQb
VDDQ
VSS
DQb
VSS
VDDQ
DQb
VSS
NC
VDD
ZZ
DQa
VDDQ
VSS
DQa
VSS
VDDQ
DQa
DQPa
A
CE
CE2
BWd
BWc
BWb
BWa
CE
2
VDD
VSS
CL
K
GW
BWE
OE
ADSC
ADSP
ADV
A
DQPc
DQc
VDDQ
VSS
DQc
VSS
VDDQ
DQc
NC
VDD
NC
VSS
DQd
VDDQ
VSS
DQd
VSS
VDDQ
DQd
DQPd
1
2
3
4
5
6
7
8
9
10
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80
79
78
77
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71
70
69
68
67
66
65
64
63
62
61
60
59
58
57
56
55
54
53
52
51
100 99 98 97 96 95 94 93 92 91 90 89 88 87 86 85 84 83 82 81
31 32 33 34 35 36 37 38 39 40 41 42 43 44 45
MODE
A
A1
A0
NC
A
VSS
VDD
A
46 47 48 49 50
1M x 36
100-Pin TQFP
PIN DESCRIPTIONS
A0, A1
Synchronous Address Inputs. These
pinsmusttiedtothetwoLSBsofthe
address bus.
A
Synchronous Address Inputs
ADSC
Synchronous Controller Address Status
ADSP
SynchronousProcessorAddressStatus
ADV
SynchronousBurstAddressAdvance
BWa
-BWd
SynchronousByteWriteEnable
BWE
SynchronousByteWriteEnable
CE
,CE2,CE2 SynchronousChipEnable
CLK
Synchronous Clock
DQa-DQd
SynchronousDataInput/Output
DQPa-DQPd
ParityDataInput/Output
vss
Ground
GW
SynchronousGlobalWriteEnable
MODE
BurstSequenceModeSelection
OE
OutputEnable
Vdd
3.3v/2.5vPowerSupply
Vddq
IsolatedOutputBufferSupply:
3.3v/2.5v
ZZ
SnoozeEnable
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