参数资料
| 型号： | ISL6323ACRZ |
| 厂商： | Intersil |
| 文件页数： | 16/36页 |
| 文件大小： | 0K |
| 描述： | IC PWM CTRLR SYNC BUCK DL 48QFN |
| 标准包装： | 43 |
| 应用： | 控制器，AMD SVI |
| 输入电压： | 5 V ~ 12 V |
| 输出数： | 2 |
| 输出电压： | 最高 2V |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 供应商设备封装： | 48-QFN（7x7） |
| 包装： | 管件 |
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ISL6323A
multi-phase Core and single-phase North Bridge Regulators
TABLE 1. 6-BIT PARALLEL VID CODES (Continued)
are disabled and the ISL6323A is continuously sampling
voltage on the VID1/SEL pin. When the EN pin is toggled
HIGH, the status of the VID1/SEL pin will latch the ISL6323A
into either PVI or SVI mode. This latching occurs on the rising
edge of the EN signal.If the VID1/SEL pin is held LOW during
the latch, the ISL6323A will be placed into SVI mode. If the
VID1/SEL pin is held HIGH during the latch, the ISL6323A will
be placed into PVI mode. For the ISL6323A to properly enter
into either mode, the level on the VID1/SEL pin must be stable
no less than 1μs prior to the EN signal transitioning from low to
high.
6-Bit Parallel VID Interface (PVI)
With the ISL6323A in PVI mode, the single-phase North
Bridge regulator is disabled. Only the multi-phase controller
is active in PVI mode to support uniplane VDD only
processors. Table 1 shows the 6-bit parallel VID codes and
the corresponding reference voltage.
TABLE 1. 6-BIT PARALLEL VID CODES
VID5
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FN6878.1
May 12, 2010
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PDF描述 |
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