参数资料
| 型号： | ISL6548ACRZA-T |
| 厂商： | Intersil |
| 文件页数： | 6/16页 |
| 文件大小： | 0K |
| 描述： | IC REG/CTLR ACPI DUAL DDR 28QFN |
| 标准包装： | 1 |
| 应用： | 存储器，DDR/DDR2 稳压器 |
| 电流 - 电源： | 7mA |
| 工作温度： | 0°C ~ 70°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 28-VQFN 裸露焊盘 |
| 供应商设备封装： | 28-QFN（6x6） |
| 包装： | 标准包装 |
| 产品目录页面： | 1243 (CN2011-ZH PDF) |
| 其它名称： | ISL6548ACRZA-TDKR |
ISL6548A
Electrical Specifications
Recommended Operating Conditions, Unless Otherwise Noted. Refer to Block and Simplified Power System
Diagrams and Typical Application Schematics (Continued)
PARAMETER
SYMBOL
TEST CONDITIONS
MIN
TYP
MAX
UNITS
PWM CONTROLLER GATE DRIVERS
UGATE and LGATE Source
UGATE and LGATE Sink
I GATE
I GATE
-
-
-0.8
0.8
-
-
A
A
VTT REGULATOR
Upper Divider Impedance
Lower Divider Impedance
R U
R L
-
-
2.5
2.5
-
-
k ?
k ?
Maximum V TT Load Current
I VTT_MAX
Periodic load applied with 30% duty cycle and
10ms period using ISL6548A_6506EVAL1
-3
-
3
A
evaluation board (see Application Note AN1124)
LINEAR REGULATORS
DC Gain
Gain Bandwidth Product
Slew Rate
DRIVEn High Output Voltage
DRIVEn Low Output Voltage
DRIVEn High Output Source Current
DRIVEn Low Output Sink Current
GBWP
SR
Guaranteed By Design
DRIVEn Unloaded
V FB = 770mV, V DRIVEn = 0V
V FB = 830mV, V DRIVEn = 10V
-
15
-
9.75
-
-
-
80
-
6
10.0
0.16
1.7
1.20
-
-
-
-
0.50
-
-
dB
MHz
V/ μ s
V
V
mA
mA
VIDPGD
V TT_GMCH/CPU Rising Threshold
V TT_GMCH/CPU Falling Threshold
S0
S0
.725
-
.740
0.700
-
0.715
V
V
PROTECTION
OCSET Current Source
V TT_DDR Current Limit
I OCSET
By Design
18
-3.3
20
-
22
3.3
μ A
A
V DDQ OV Level
V DDQ UV Level
V FB /V REF
V FB /V REF
S0/S3
S0/S3
-
-
115
85
-
-
%
%
V TT_DDR OV Level
V TT_DDR UV Level
V TT /V VREF_IN S0
V TT /V VREF_IN S0
-
-
115
85
-
-
%
%
V GMCH UV Level
V TT_GMCH/CPU UV Level
Thermal Shutdown Limit
V FB4 /V REF
V FB2 /V REF
T SD
S0
S0
By Design
-
-
-
85
85
140
-
-
-
%
%
°C
Functional Pin Description
5VSBY (Pin 1)
5VSBY is the bias supply of the ISL6548A. It is typically
connected to the 5V standby rail of an ATX power supply.
During S4/S5 sleep states the ISL6548A enters a reduced
power mode and draws less than 1mA (I CC_S5 ) from the
5VSBY supply. The supply to 5VSBY should be locally
bypassed using a 0.1 μ F capacitor.
6
P12V (Pin 3)
The V TT regulation circuit and the Linear Drivers are
powered by P12V. P12V is not required during S3/S4/S5
operation. P12V is typically connected to the +12V rail of an
ATX power supply.
GND (Pins 4, 27, 29)
The GND terminals of the ISL6548A provide the return path
for the V TT LDO, and switching MOSFET gate drivers. High
ground currents are conducted directly through the exposed
paddle of the QFN package which must be electrically
connected to the ground plane through a path as low in
inductance as possible.
FN9189.2
January 3, 2006
相关PDF资料 |
PDF描述 |
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参数描述 |
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