参数资料
| 型号： | ISL9106IRZ |
| 厂商： | Intersil |
| 文件页数： | 7/13页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK SYNC ADJ 1.2A 10DFN |
| 标准包装： | 100 |
| 类型： | 降压（降压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 0.8 V ~ 5.5 V |
| 输入电压： | 2.7 V ~ 5.5 V |
| PWM 型： | 电流模式 |
| 频率 - 开关： | 1.6MHz |
| 电流 - 输出： | 1.2A |
| 同步整流器： | 是 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-VFDFN 裸露焊盘 |
| 包装： | 管件 |
| 供应商设备封装： | 10-DFN（3x3） |
ISL9106
Typical Operating Performance (Continued)
2V/DIV
V SW
2V/DIV
V SW
100mV/DIV
V OUT (AC COUPLED)
100mV/DIV
V OUT (AC COUPLED)
I L
1A/DIV
100 μ s/DIV
FIGURE 19. LOAD TRANSIENT TEST (MODE = V IN = 5.0V;
V O = 2.5V; I O = 0.01A~1A)
V SW
2V/DIV
I L
1A/DIV
100μs/DIV
FIGURE 20. LOAD TRANSIENT TEST (MODE = GND,
V IN = 5.0V; V O = 2.5V; I O = 0.01A~1A)
V SW
2V/DIV
50mV/DIV
V OUT (AC COUPLED)
100mV/DIV
V OUT (AC COUPLED)
I L
0.5A/DIV
I OUT
0.2A/DIV
1A/DIV
I L
100μs/DIV
FIGURE 21. LOAD TRANSIENT TEST (MODE = V IN = 5V;
V O = 3.3V; I O = 0.2A~0.4A)
Pin Descriptions
VIN
Input supply voltage. Connect a 10 μ F ceramic capacitor to
power ground.
NC
No connect.
EN
Enable pin. Enable the device when driven to high. Shut
down the chip and discharge output capacitor when driven to
low. Do not leave this pin floating.
7
100 μ s/DIV
FIGURE 22. LOAD TRANSIENT TEST (MODE = GND,
V IN = 5.0V; V O = 3.3V; I O = 0.01A~1A)
PG
215ms timer output. This output is a 215ms delayed power-
good signal (PG) for the output voltage when output voltage
is within the power-good window. It can be reset by a high
RSI signal, then 215ms starts when RSI goes from high to
low.
MODE
Mode selection pin. Connect to logic high or input voltage
VIN for low I Q mode; connect to logic low or ground for
forced PWM mode. Do not leave this pin floating.
SW
Switching node connection. Connect to one terminal of
inductor.
FN6509.0
June 29, 2007
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PDF描述 |
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参数描述 |
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