参数资料
| 型号： | ISL97651ARTZ-T |
| 厂商： | Intersil |
| 文件页数： | 17/19页 |
| 文件大小： | 0K |
| 描述： | IC LCD SUPPLY HP 4CHN 36-TQFN |
| 标准包装： | 4,000 |
| 应用： | LCD 电视机/监控器 |
| 电流 - 电源： | 400µA |
| 电源电压： | 4 V ~ 5.5 V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 36-WFQFN 裸露焊盘 |
| 供应商设备封装： | 36-TQFN 裸露焊盘（6x6） |
| 包装： | 带卷 (TR) |
ISL97651
A VDD_delay Generation Using DELB
DELB pin is an open drain internal N-FET output used to
drive an external optional P-FET to provide a delayed A VDD
supply which also has no initial pedistal voltage (see
across the source and gate, hence M0 will be off. Please
note that the maximum leakage of DELB in this period is
500nA. To avoid any mis-trigger, the maximum value of R4
should be less than:
Figure 15 and compare the A VDD and A VDD_delayed
curves). When the part is enabled, the N-FET is held off until
C DLY reaches the 4th peak in the start-up sequence. During
V GS ( th ) _min(M0)
500nA
R 4_max < --------------------------------------------
(EQ. 23)
this period, the voltage potential of the source and gate of
the external P-FET (M0 in application diagram) should be
almost the same due to the presence of the resistor (R4)
Where V GS(th)_min(M0) is the minimum value of gate
threshold voltage of M0.
V CDLY
V IN
EN
V REF
V BOOST
(A VDD )
t START-UP
t SS
V LOGIC
V OFF
t VOFF
DELAYED
V BOOST
(A VDD_delay )
t VON
V ON
V ON SLICE
t VON-SLICE
START-UP SEQUENCE
NORMAL
FAULT
NOTE: Not to scale
TIMED BY C DLY
OPERATION
PRESENT
FIGURE 15. START-UP SEQUENCE
17
FN7493.3
April 24, 2009
相关PDF资料 |
PDF描述 |
|---|---|
| ISL97652IRZ | IC LCD SUPPLY HP 4CHN 48-QFN |
| ISL97653AIRZ | IC LCD SUPPLY 5CHN 40-QFN |
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| ISL97701IRZ | IC REG BOOST ADJ 0.1A 10DFN |
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相关代理商/技术参数 |
参数描述 |
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