参数资料
| 型号： | ISLA212P20IRZ |
| 厂商： | Intersil |
| 文件页数： | 16/36页 |
| 文件大小： | 0K |
| 描述： | IC ADC 12BIT SRL/SPI 72QFN |
| 标准包装： | 1 |
| 系列： | FemtoCharge™ |
| 位数： | 12 |
| 采样率（每秒）： | 200M |
| 数据接口： | 串行，SPI? |
| 转换器数目： | 1 |
| 功率耗散（最大）： | 468mW |
| 电压电源： | 模拟和数字 |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 72-VFQFN 裸露焊盘 |
| 供应商设备封装： | 72-QFN（10x10） |
| 包装： | 托盘 |
| 输入数目和类型： | * |
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ISLA212P
23
FN7717.2
November 30, 2012
FIGURE 35. SYNCHRONOUS RESET OPERATION, CLOCK DIVIDE = 2, DDR-MODE
s0
EVEN
s1
ODD
s0
ODD
CLKDIVRSTP
ADC1 OUTPUT DATA
ADC1 CLKOUTP
ADC2 CLKOUTP
(PHASE 1)
ADC2 CLKOUTP
(PHASE 2)
L+td
tRSTH
tRSTS
tRSTRT
ADC2 OUTPUT DATA
ANALOG INPUT
DEVICE CLOCK
INPUT
s1
EVEN
s0
EVEN
s1
ODD
s0
ODD
s1
EVEN
NOTES:
13. Delay equals fixed pipeline latency (L cycles of sample clock) plus fixed analog propagation
delay, td.
14. CLKDIVRSTP setup and hold times are with respect to input sample clock rising edge.
CLKDIVRSTN is not shown but must be driven, and is the complement of CLKDIVRSTP.
15. Either Output Clock Phase (phase 1 or phase 2 ) equally likely prior to synchronization.
(Note 15)
(Note 14)
(Note 13)
DEVICE CLOCK
NPUT
(Note 15)
FIGURE 36. MSB-FIRST ADDRESSING
CSB
SCLK
SDIO
R/W
W1
W0
A12
A11
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
A10
FIGURE 37. LSB-FIRST ADDRESSING
CSB
SCLK
SDIO
R/W
W1
W0
A12
A11
A1
A0
D7
D6
D5
D4
D3
D2
D1
D0
A2
相关PDF资料 |
PDF描述 |
|---|---|
| ISLA214S50IR1Z | IC ADC |
| ISLA222P13IRZ | IC ADC 12BIT SRL/SPI 72QFN |
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相关代理商/技术参数 |
参数描述 |
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| ISLA212P25IRZ | 制造商:Intersil Corporation 功能描述:12-BIT 250MSPS ADC, 72-PIN QFN - Trays 制造商:Intersil Corporation 功能描述:IC ADC 12BIT SPI/SRL 250M 72QFN |
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| ISLA212P50_1105 | 制造商:INTERSIL 制造商全称:Intersil Corporation 功能描述:12-Bit, 500MSPS ADC Programmable Built-in Test Patterns |
| ISLA212P50IRZ | 制造商:Intersil Corporation 功能描述:12-BIT 500MSPS ADC, 72-PIN QFN - Bulk 制造商:Intersil 功能描述:Intersil ISLA212P50IRZ Analog to Digital Converters (ADC) 制造商:Intersil Corporation 功能描述:IC ADC 12BIT SRL/SPI 72QFN 制造商:Intersil 功能描述:12-BIT 500MSPS ADC 7 2-PIN |
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