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参数资料
| 型号： | IXF1010 |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 10 CHANNEL(S), 1000M bps, LOCAL AREA NETWORK CONTROLLER, CBGA552 |
| 封装： | 25 X 25 MM, 1 MM PITCH, CERAMIC, BGA-552 |
| 文件页数： | 49/116页 |
| 文件大小： | 1392K |
| 代理商： | IXF1010 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页当前第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页
IXF1010 — 10-Port 100/1000 Mbps Ethernet MAC
38
Preliminary Datasheet
Document #: 249839
Revision #: 001
Rev. Date: April 29, 2002
3.4.5.2
MDC Low-Frequency Operation
The low-frequency MDC is 2.5 MHz, which is derived from the 125 MHz system clock by
dividing the frequency by 50.
The duty cycle is as follows:
MDC High duration: 25 x (1/125 MHz) = 25 x 8 ns = 200 ns
MDC Low duration: 25 x (1/125 MHz) = 25 x 8 ns = 200 ns
MDC runs continuously after reset
3.4.6
MDIO Management Frames
The MDIO Management interface serializes the external register access information into the
format specified by IEEE 802.3, Clause 22, Section 2.4.5.
Figure 11. High-Frequency MDC Timing Diagram
24 ns
(3 X 125 MHz clocks)
32 ns
(4 X 125 MHz clocks)
MDC
Internal
125 MHz Clock
Figure 12. Low-Frequency MDC Timing Diagram
Internal 125 MHz
Clock
MDC
200 ns
(25 X 125 MHz Clocks)
200 ns
(25 X 125 MHz Clocks)
Figure 13. MDIO Management Frame Structure
Preamble
32 Bits
Start
2 Bits
Op Code
2 Bits
PHY Addr
5 Bits
Turnaround
2 Bits
Data
16 Bits
First Bit Transmitted
Last Bit Transmitted
REG Addr
5 Bits
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PDF描述 |
|---|---|
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