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参数资料
型号： KMPC8548EVUAQG
厂商： Freescale Semiconductor
文件页数： 101/151页
文件大小： 0K
描述： IC MPU PWRQUICC III 783-FCCBGA
标准包装： 2
系列： MPC85xx
处理器类型： 32-位 MPC85xx PowerQUICC III
速度： 1.0GHz
电压： 1.1V
安装类型： 表面贴装
封装/外壳： 783-BBGA，FCBGA
供应商设备封装： 783-FCPBGA（29x29）
包装： 托盘
MPC8548E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 9
Freescale Semiconductor
53
Programmable Interrupt Controller
11
Programmable Interrupt Controller
In IRQ edge trigger mode, when an external interrupt signal is asserted (according to the programmed
polarity), it must remain the assertion for at least 3 system clocks (SYSCLK periods).
12 JTAG
This section describes the DC and AC electrical specifications for the IEEE 1149.1 (JTAG) interface of
the device.
12.1
JTAG DC Electrical Characteristics
This table provides the DC electrical characteristics for the JTAG interface.
12.2
JTAG AC Electrical Specifications
This table provides the JTAG AC timing specifications as defined in Figure 30 through Figure 32.
Table 43. JTAG DC Electrical Characteristics
Parameter
Symbol1
Min
Max
Unit
High-level input voltage
VIH
2OVDD + 0.3
V
Low-level input voltage
VIL
–0.3
0.8
V
Input current (VIN
1 = 0 V or V
IN = VDD)IIN
—±5
A
High-level output voltage (OVDD = min, IOH = –2 mA)
VOH
2.4
—
V
Low-level output voltage (OVDD = min, IOL = 2 mA)
VOL
—0.4
V
Note:
1. Note that the symbol VIN, in this case, represents the OVIN.
Table 44. JTAG AC Timing Specifications (Independent of SYSCLK)1
Parameter
Symbol2
Min
Max
Unit
Notes
JTAG external clock frequency of operation
fJTG
033.3
MHz
—
JTAG external clock cycle time
t JTG
30
—
ns
—
JTAG external clock pulse width measured at 1.4 V
tJTKHKL
15
—
ns
—
JTAG external clock rise and fall times
tJTGR & tJTGF
02
ns
6
TRST assert time
tTRST
25
—
ns
3
Input setup times:
Boundary-scan data
TMS, TDI
tJTDVKH
tJTIVKH
4
0
—
ns
4
Input hold times:
Boundary-scan data
TMS, TDI
tJTDXKH
tJTIXKH
20
25
—
ns
4
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