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参数资料
| 型号： | KSZ8842-PMBL AM |
| 厂商： | Micrel Inc |
| 文件页数： | 81/119页 |
| 文件大小： | 0K |
| 描述： | IC ETHERNET SW 2PORT 100-LFBGA |
| 标准包装： | 260 |
| 控制器类型： | 以太网开关控制器 |
| 接口： | PCI |
| 电源电压： | 3.1 V ~ 3.5 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LFBGA |
| 供应商设备封装： | 100-LFBGA |
| 包装： | 托盘 |
| 产品目录页面： | 1081 (CN2011-ZH PDF) |
| 配用： | 576-1636-ND - BOARD EVALUATION KSZ8842-PMQL |
| 其它名称： | 576-3348 |
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Micrel, Inc.
KSZ8842-PMQL/PMBL
October 2007
64
M9999-100207-1.5
Indirect Access Control Register (Offset 0x04A0): IACR
This register contains the indirect control for the switch function.
Bit
Default
R/W
Description
15 – 13
000
RW
Reserved
12
0
RW
Read High. Write Low
1 = read cycle
0 = write cycle
11:10
00
RW
Table select
00 = static MAC address table selected
01 = VLAN table selected
10 = dynamic address table selected
11 = MIB counter selected
9 – 0
0x000
RW
Indirect address
Bit 9-0 of indirect address
Note: (1) write IACR will actually trigger a command.
Read or write access is determined by Register bit 12.
Indirect Access Data Register 1 (Offset 0x04A2): IADR1
This register contains the indirect data for the switch function.
Bit
Default
R/W
Description
15 – 8
0x000
RO
Reserved
7
0
RO
CPU Read Status
Only for dynamic and statistics counter reads.
1 = read is still in progress
0 = read has completed
6 – 3
0x0
RO
Reserved
2 – 0
000
RO
Indirect data.
Bit 66-64 of indirect data
Indirect Access Data Register 2 (Offset 0x04A4): IADR2
This register contains the indirect data for the switch function.
Bit
Default
R/W
Description
15 – 0
0x0000
RW
Indirect data
Bit 47-32 of indirect data
Indirect Access Data Register 3 (Offset 0x04A6): IADR3
This register contains the indirect data for the switch function.
Bit
Default
R/W
Description
15 – 0
0x0000
RW
Indirect data
Bit 63-48 of indirect data
Indirect Access Data Register 4 (Offset 0x04A8): IADR4
This register contains the indirect data for the switch function.
Bit
Default
R/W
Description
15 – 0
0x0000
RW
Indirect data
Bit 15-0 of indirect data
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