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参数资料
| 型号： | LC4128ZC-75TN100E |
| 厂商： | Lattice Semiconductor Corporation |
| 文件页数： | 26/99页 |
| 文件大小： | 0K |
| 描述： | IC CPLD 128MACROCELLS 100TQFP |
| 标准包装： | 90 |
| 系列： | ispMACH® 4000Z |
| 可编程类型： | 系统内可编程 |
| 最大延迟时间 tpd(1)： | 7.5ns |
| 电压电源 - 内部： | 1.7 V ~ 1.9 V |
| 逻辑元件/逻辑块数目： | 8 |
| 宏单元数： | 128 |
| 输入/输出数： | 64 |
| 工作温度： | -40°C ~ 130°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 100-LQFP |
| 供应商设备封装： | 100-TQFP（14x14） |
| 包装： | 托盘 |
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Lattice Semiconductor
ispMACH 4000V/B/C/Z Family Data Sheet
Timing Model
The task of determining the timing through the ispMACH 4000 family, like any CPLD, is relatively simple. The timing
model provided in Figure 11 shows the specific delay paths. Once the implementation of a given function is deter-
mined either conceptually or from the software report file, the delay path of the function can easily be determined
from the timing model. The Lattice design tools report the timing delays based on the same timing model for a par-
ticular design. Note that the internal timing parameters are given for reference only, and are not tested. The exter-
nal timing parameters are tested and guaranteed for every device. For more information on the timing model and
usage, refer to TN1004, ispMACH 4000 Timing Model Design and Usage Guidelines .
Figure 11. ispMACH 4000 Timing Model
Routing/GLB Delays
From
Feedback
t PDb
t PDi
t FBK
Feedback
IN
t IN
t IOI
t INREG
t ROUTE
t BLA
t MCELL
t EXP
DATA
Q
t ORP
t BUF
t IOO
t EN
Out
t INDIO
t DIS
SCLK
t GCLK_IN
t IOI
t PTCLK
t BCLK
t PTSR
t BSR
C.E.
S/R
MC Reg.
Register/Latch
In/Out
Delays
Delays
Control
Delays
t GPTOE
t PTOE
OE
t GOE
t IOI
In/Out
Delays
26
Note: Italicized items are optional delay adders.
相关PDF资料 |
PDF描述 |
|---|---|
| LCMXO1200E-5T144C | IC PLD 1200LUTS 113I/O 144-TQFP |
| GRM32QR73A103KW01L | CAP CER 10000PF 1KV 10% X7R 1210 |
| LCMXO1200E-4T144I | IC PLD 1200LUTS 113I/O 144-TQFP |
| GEM03DSUN | CONN EDGECARD 6POS DIP .156 SLD |
| LLA315R71A474MA14L | CAP CER 0.47UF 10V 20% X7R 1206 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| LC4128ZC-75TN100I | 功能描述:CPLD - 复杂可编程逻辑器件 PROGRAMMABLE SUPER FAST HI DENSITY PLD RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
| LC4128ZE5MN100C | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:1.8V In-System Programmable Ultra Low Power PLDs |
| LC4128ZE5MN100CES | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:1.8V In-System Programmable Ultra Low Power PLDs |
| LC4128ZE5MN100I | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:1.8V In-System Programmable Ultra Low Power PLDs |
| LC4128ZE5MN100IES | 制造商:LATTICE 制造商全称:Lattice Semiconductor 功能描述:1.8V In-System Programmable Ultra Low Power PLDs |
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