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参数资料
型号： LC51024VG-75F676I
厂商： LATTICE SEMICONDUCTOR CORP
元件分类： PLD
中文描述： EE PLD, 7.5 ns, PBGA676
封装： FBGA-676
文件页数： 18/48页
文件大小： 237K
代理商： LC51024VG-75F676I
Lattice Semiconductor
ispMACH 5000VG Family Data Sheet
25
LVDS_in
tGCLK_IN
Using LVDS
standard
—
1.70
—
1.70
—
1.70
—
1.70
ns
LVPECL_in
tGCLK_IN
Using LVPECL
standard
—
2.10
—
2.10
—
2.10
—
2.10
ns
tIOO Output Adders
LVCMOS18_4mA_out
tBUF, tEN, tDIS
Output congured as
1.8V & 4mA Buffer
—
3.00
—
3.00
—
3.00
—
3.00
ns
LVCMOS18_5mA_out
tBUF, tEN, tDIS
Output congured as
1.8V & 5.33mA Buffer
—
2.50
—
2.50
—
2.50
—
2.50
ns
LVCMOS18_8mA_out
tBUF, tEN, tDIS
Output congured as
1.8V & 8mA Buffer
—
1.85
—
1.85
—
1.85
—
1.85
ns
LVCMOS18_12mA_out
tBUF, tEN, tDIS
Output congured as
1.8V & 12mA Buffer
—
1.35
—
1.35
—
1.35
—
1.35
ns
LVCMOS25_4mA_out
tBUF, tEN, tDIS
Output congured as
2.5V & 4mA Buffer
—
1.50
—
1.50
—
1.50
—
1.50
ns
LVCMOS25_5mA_out
tBUF, tEN, tDIS
Output congured as
2.5V & 5.33mA Buffer
—
1.25
—
1.25
—
1.25
—
1.25
ns
LVCMOS25_8mA_out
tBUF, tEN, tDIS
Output congured as
2.5V & 8mA Buffer
—
0.70
—
0.70
—
0.70
—
0.70
ns
LVCMOS25_12mA_out
tBUF, tEN, tDIS
Output congured as
2.5V & 12mA Buffer
—
0.50
—
0.50
—
0.50
—
0.50
ns
LVCMOS25_16mA_out
tBUF, tEN, tDIS
Output congured as
2.5V & 16mA Buffer
—
0.25
—
0.25
—
0.25
—
0.25
ns
LVCMOS33_4mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 4mA Buffer
—
1.50
—
1.50
—
1.50
—
1.50
ns
LVCMOS33_5mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 5.33mA Buffer
—
1.25
—
1.25
—
1.25
—
1.25
ns
LVCMOS33_8mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 8mA Buffer
—
0.40
—
0.40
—
0.40
—
0.40
ns
LVCMOS33_12mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 12mA Buffer
—
0.10
—
0.10
—
0.10
—
0.10
ns
LVCMOS33_16mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 16mA Buffer
—0.0—0.0—
0.0
—
0.0
ns
LVCMOS33_20mA_out
tBUF, tEN, tDIS
Output congured as
3.3V & 20mA Buffer
—0.0—0.0—
0.0
—
0.0
ns
LVTTL
tBUF, tEN, tDIS
Output congured as
LVTTL Buffer
—0.0—0.0—
0.0
—
0.0
ns
Slow Slew
tBUF, tEN
Output congured for
slow slew rate
—
1.50
—
1.50
—
1.50
—
1.50
ns
PCI_out
tBUF, tEN, tDIS Using PCI standard
—
0.0
—
0.0
—
0.0
—
0.0
ns
PCI_X_out
tBUF, tEN, tDIS
Using PCI-X
standard
—0.0—0.0—
0.0
—
0.0
ns
AGP_1X_out
tBUF, tEN, tDIS
Using AGP-1X
standard
—0.0—0.0—
0.0
—
0.0
ns
SSTL3_I_out
tBUF, tEN, tDIS
Using SSTL3_I
standard
—
-0.25
—
-0.25
—
-0.25
—
-0.25
ns
SSTL3_II_out
tBUF, tEN, tDIS
Using SSTL3_II
standard
—
-0.35
—
-0.35
—
-0.35
—
-0.35
ns
ispMACH 51024VG Timing Adders (Continued)
Adder
Type
Base
Parameter
Description
-5
-75
-10
-12
Units
Min
Max
Min
Max
Min
Max
Min
Max
Note: Open drain timing is the same as corresponding LVCMOS timing.
Timing v.1.10
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