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参数资料
| 型号： | LM9617CCEA-2 |
| 厂商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, CQCC48 |
| 封装： | LCC-48 |
| 文件页数： | 27/40页 |
| 文件大小： | 408K |
| 代理商： | LM9617CCEA-2 |
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Confidential
33
www.national.com
Timing Information (continued)
2.0
DIGITAL VIDEO PORT SLAVE MODE TIMING
Figure 54. Slave Mode Row Trigger and Readout Timing
Figure 55. Slave Mode d[11:0], hsync & vsync to pclk Timing
Figure 56. Rising Edge of mclk to Valid Pixel Data
The following specifications apply for all supply pins = +3.0V & CL = 10pF unless otherwise noted. Boldface limits apply for TA =
TMIN to TMAX: all other limits TA = 25
oC (Note 7)
Label
Descriptions
Min
Typ
Max
t1
Pulse width of row trigger
2
* mclk
t2
First pixel out after rising edge of row trigger
124 * mclk
t3
Minimum time between row triggers.
780 * mclk
t4
Max time to assert next frame trigger after last row
trigger.
96 * mclk
t5
Pulse width of Frame trigger
2
* mclk
t6
Time to valid pixel data after rising edge of mclk
44ns
hsync
d[11:0]
mclk
t3
P1
P652
P653
P654
P655
P640
P652
P653
P654
Row n-1
Row n
trigger row n
trigger row n+1
t1
t2
vsync
hsync
trigger last row
mclk
trigger Frame n+1
t4
in frame n
t5
d[11:0]
mclk
t6
L
M
9
6
1
7
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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