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参数资料
| 型号： | LM98640W-MPR |
| 厂商： | NATIONAL SEMICONDUCTOR CORP |
| 元件分类： | 模拟信号调理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, CQFP68 |
| 封装： | CERAMIC, QFP-68 |
| 文件页数： | 36/50页 |
| 文件大小： | 1688K |
| 代理商： | LM98640W-MPR |
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Registers need to be written with baseline values after power-up to place part in a valid state.
Address
(Binary)
Register Title
Baseline
(Binary)
Bit(s)
Description
00 0010
PGA Power Trimming 0010 0100
[7:0]
PGA Power Trimming Register.
[7:6]
Not Used
[5:3]
PGA Stage 1 Current Trimming
Tunable between 000-Weak to 111-Strong (Default 100)
[2:0]
PGA Stage 2 Current Trimming
Tunable between 000-Weak to 111-Strong (Default 100)
00 0011
ADC Power Trimming 0101 1011
[7:0]
ADC Power Trimming Register.
[7:6]
Reserved. Set to 2'b01.
[5:3]
ADC Current Trimming 2(Not Binary Weighted)
000
25% Power
001
50% Power
011
75% Power (Default)
111
100% Power
[2:0]
ADC Current Trimming 1 (Not Binary Weighted)
000
25% Power
001
50% Power
011
75% Power (Default)
111
100% Power
00 0100
VCLP Control
0111 0100
[7:0]
Voltage Clamp Buffer Control Register.
[7]
Not Used
[6]
Buffer Enable
0
Disabled. Resistor Ladder is driving VCLP pin.
1
Enabled. Resistor Ladder is buffered to VCLP pin.
[5]
VCLP Enable
0
Disabled. VCLP pin can be externally driven.
1
Enabled. VCLP pin is in output mode.
[4:0]
Voltage Level of VCLP pin.
VCLP range is 200mV to 3.1V in 100mV steps for
(binary) settings 00000 to 11101. Settings 11110 and
11111 are not used.
41
www.national.com
LM98640QML
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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