参数资料
| 型号： | LV5052V-TLM-E |
| 厂商： | ON Semiconductor |
| 文件页数： | 8/9页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR BUCK PWM 30SSOP |
| 标准包装： | 1,000 |
| PWM 型： | 控制器 |
| 输出数： | 2 |
| 频率 - 最大： | 1.1MHz |
| 电源电压： | 9.4 V ~ 16 V |
| 降压： | 是 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 无 |
| 工作温度： | -20°C ~ 85°C |
| 封装/外壳： | 30-LSSOP（0.220"，5.60mm 宽） |
| 包装： | 带卷 (TR) |
LV5052V
Start-up Sequence
Each signal control timing at power supply ON is as below.
VIN
VLIN5
9V typ
4.5V typ
UVLO release *
VIN=12V
VLIN5=5V
2.4V typ
TD=5V
TD
SS=1.6V
SS
0.8V
VOUT
Vout × 82%
VOUT=Vout × 100%
PGOOD
* Starts charging the TD at the trigger point of either VIN > 9V(typ) or VLIN5 > 4.5V(typ), whichever is later.
Protection Operate Sequence
(1) Latch-off release by UVLO
The signal control timing diagram for resetting the latch-off condition using UVLO is shown below.
VIN=12V
VIN
8V typ
9V typ
Restart
VLIN5=5V
VLIN5
TD
SS
TD discharge start
2.4V typ
0.8V
TD=5V
SS=1.6V
VOUT
Vout × 118%
Vout × 82%
OVP
VOUT=Vout × 100%
Vout × 82%
PGOOD
(2) Latch off release by TD
The signal control timing diagram for resetting the latch-off condition using UVLO is shown below.
VIN=12V
VIN
VLIN5=5V
VLIN5
TD
SS
TD discharge start
2.4V typ
0.8V
TD=5V
SS=1.6V
VOUT
Vout × 118%
Vout × 82%
OVP
VOUT=Vout × 100%
Vout × 82%
PGOOD
No.A1394-8/9
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