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参数资料
| 型号： | LV5256GP-TE-L-E |
| 厂商： | ON Semiconductor |
| 文件页数： | 5/9页 |
| 文件大小： | 0K |
| 描述： | IC REG BUCK BOOST SYNC ADJ VCT20 |
| 标准包装： | 2,000 |
| 类型： | 降压（降压），升压（升压） |
| 输出类型： | 可调式 |
| 输出数： | 1 |
| 输出电压： | 1 V ~ 14 V |
| 输入电压： | 4.5 V ~ 10 V |
| 频率 - 开关： | 300kHz ~ 1.5MHz |
| 电流 - 输出： | 600mA |
| 同步整流器： | 是 |
| 工作温度： | -20°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 20-WFQFN |
| 包装： | 带卷 (TR) |
| 供应商设备封装： | 20-VCT（3x3） |
LV5256GP
Block Diagrams and Sample Application Circuit 1 (Step-down)
100k Ω at 1MHz
0.1 μ F
REG_O
RT
disable
VIN
VIN=4.5 to 10V
BIAS
VREF
VREG
UVLO
OSC
1 μ F
ot
Vref
V1
or
V2
FB
IN
disable
TSD
Vref1R2
(1.2V)
(1.0V±1%)
+
+
+
3.3V
1.0V
0.5V
disable
ot
uvlo
tout
2.8V/2.5V
uvlo
pwm Control
Logic
L/S
Vout-5
VREG
LDO with OPC
Vout-5
VOUT
VOUT-5
22 μ H
SW
0.022 μ F
V1 (Normal operation)
=1.0V to VIN
V2 (Tracking operaton)
=0V to VIN
4.7 μ F
+
du_sel
SBD
0.01 μ F at 1.25ms
OCP
disable
uvlo
R
SQ
tout
PGND
LGND
GND/
OPEN
DU_SEL
L/S
+
du_sel
vdd
VDD
VDD=2.9 to 3.1V
+
+
+
× 0.8
× 0.4
VrefR2
disable disable
uvlo
0.1 μ F
OPC_SEL
GND/OPEN: × 0.8
REG_O: × 0.4
Vref
+
Vref1R2
TRAC_IN
SS
ONOFF
pin heap 17 pin
0.033 μ F at 3.3ms
Sample Application Circuit 2 (Step-up)
100k Ω at 1MHz
0.1 μ F
REG_O
RT
disable
VIN
VIN=4.5~10V
BIAS
VREF
VREG
UVLO
OSC
1 μ F
disable
TSD
ot
Vref
Vref1R2
(1.2V)
3.3V
1.0V
0.5V
2.8V/2.5V
uvlo
LDO with OPC
VOUT
VOUT1 (Normal operation)
=5.3V to 14V
VOUT1
or
VOUT2
FB
IN
(1.0V±1%)
+
+
+
disable
ot
uvlo
tout
pwm Control
Logic
L/S
Vout-5
VREG
Vout-5
VOUT-5
SW
VOUT2 (Tracking operaton)
=VIN or more
4.7 μ F
10 μ H
+
du_sel
0.01 μ F at 1.25ms
OCP
disable
uvlo
R
SQ
tout
PGND
LGND
REG_O
DU_SEL
L/S
+
du_sel
vdd
VDD
VDD=2.9~3.1V
+
+
+
× 0.8
× 0.4
VrefR2
disable disable
uvlo
0.1 μ F
OPC_SEL
GND/OPEN: × 0.8
REG_O: × 0.4
Vref
+
Vref1R2
TRAC_IN
SS
ONOFF
pin heap 17 pin
0.033 μ F at 3.3ms
No.A1277-5/9
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PDF描述 |
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