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参数资料
| 型号： | M30245FCGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | PLASTIC, LQFP-100 |
| 文件页数： | 31/244页 |
| 文件大小： | 3535K |
| 代理商： | M30245FCGP |
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Serial Communication
Specifications in this manual are tentative and subject to change
Rev. E
MITSUBISHI MICROCOMPUTERS
M30245 Group
SINGLE-CHIP 16-BIT CMOS MICROCOMPUTER
126
Figure 1.88. UARTi block diagram
ni : Values set to UARTi bit rate generator (UiBRG)
RxDi
Reception
control circuit
Transmission
control circuit
1 / (ni+1)
1/16
1/2
Bit rate
generator
Clock synchronous type
(when internal clock is selected)
UART reception
Clock synchronous type
UART transmission
Clock synchronous type
(when internal clock is selected)
Clock synchronous type
(when external clock is
selected)
Receive
clock
Transmit
clock
CLKi
CTSi / RTSi
f1
f8
f32
Vcc
RTSi
CTSi
TxDi
RxD polarity
reversing circuit
TxD
polarity
reversing
circuit
CTS/RTS disabled
CTS/RTS
selected
CLK
polarity
reversing
circuit
Internal
External
Clock source selection
Transmit/
receive
unit
(Note)
Note :UART 2 is not CMOS output but N channel open drain output.
SP
PAR
2SP
1SP
UART
(7 bits)
UART
(8 bits)
UART(7 bits)
UART
(9 bits)
Clock
synchronous
type
Clock
synchronous type
Data bus low-order bits
TxDi
UARTi transmit register
PAR
disabled
PAR
enabled
D8
D7
D6
D5
D4
D3
D2
D1
D0
UARTItransmit buffer
register
UART
(8 bits)
UART
(9 bits)
Clock
synchronous type
UARTi receive
buffer register
UARTi receive register
2SP
1SP
UART
(7 bits)
UART
(8 bits)
UART(7 bits)
UART
(9 bits)
Clock
synchronous type
Clock
synchronous type
RxDi
UART
(8 bits)
UART
(9 bits)
Address 03AF16
Address 03AE16
Address 036F 16
Address 036E16
Address 033F16
Address 033E16
Address 032F16
Address 032E16
Address 03AB16
Address 03AA16
Address 036B 16
Address 036A 16
Address 033B16
Address 033A16
Address 032B16
Address 032A16
Data bus high-order bits
D7
D6
D5
D4
D3
D2
D1
D0
D8
000
0000
SP
PAR
"0"
Reverse
No reverse
Error signal
output circuit
RxD data
reverse circuit
Error signal output
enable
Error signal output
disable
Reverse
No reverse
Logic reverse circuit + MSB/LSB conversion circuit
PAR
enabled
PAR
disabled
UART
Clock
synchronous
type
TxD data
reverse circuit
SP
: Stop bit
PAR : Parity bit
i
: 0 to 3
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PDF描述 |
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