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参数资料
| 型号： | M30624MGP-XXXGP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 24 MHz, MICROCONTROLLER, PQFP100 |
| 封装： | 14 X 14 MM, 0.50 MM PITCH, PLASTIC, LQFP-100 |
| 文件页数： | 82/104页 |
| 文件大小： | 1313K |
| 代理商： | M30624MGP-XXXGP |
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5. Electrical Characteristics
Rev.2.41
Jan 10, 2006
Page 77 of 96
REJ03B0001-0241
Figure 5.17
Timing Diagram (5)
BCLK
CSi
td(BCLKCS)
30ns.max
ADi
td(BCLKAD)
30ns.max
ALE
30ns.max
th(BCLKALE)
4ns.min
RD
30ns.max
th(BCLKRD)
0ns.min
th(BCLKAD)
4ns.min
th(BCLKCS)
4ns.min
Hi
Z
DBi
tsu(DBRD)
50ns.min
th(RDDB)
0ns.min
tcyc
BHE
Read timing
WR,WRL,
WRH
30ns.max
th(BCLKWR)
0ns.min
BCLK
CSi
td(BCLKCS)
30ns.max
ADi
td(BCLKAD)
30ns.max
ALE
30ns.max
td(BCLKALE)
th(BCLKALE)
4ns.min
th(BCLKAD)
4ns.min
th(BCLKCS)
4ns.min
tcyc
th(WRAD)
BHE
td(BCLKDB)
40ns.max
4ns.min
th(BCLKDB)
td(DBWR)
(0.5
× tcyc40)ns.min
(0.5
× tcyc10)ns.min
th(WRDB)
DBi
Write timing
td(BCLKALE)
td(BCLKRD)
(0.5
× tcyc10)ns.min
td(BCLKWR)
0ns.min
th(RDAD)
tac2(RDDB)
Hi
Z
Memory Expansion Mode, Microprocessor Mode
(for 1-wait setting and external area access)
(1.5
× tcyc60)ns.max
tcyc=
1
f(BCLK)
VCC1=VCC2=3V
Measuring conditions
VCC1=VCC2=3V
Input timing voltage : VIL=0.6V, VIH=2.4V
Output timing voltage : VOL=1.5V, VOH=1.5V
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